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参数资料
| 型号： | TLC320AD52CDWR |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, PDSO28 |
| 封装： | PLASTIC, SO-28 |
| 文件页数： | 45/56页 |
| 文件大小： | 555K |
| 代理商： | TLC320AD52CDWR |
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vi
List of Illustrations
Figure
Title
Page
2–1 Timing Sequence of ADC Channel (Primary Communication Only)
2–2
. . . . . .
2–2 Timing Sequence of ADC Channel (Primary and Secondary
Communication)
2–2
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2–3 Timing Sequence of DAC Channel (Primary Communication Only)
2–3
. . . . . .
2–4 Timing Sequence of DAC Channel (Primary and Secondary
Communication)
2–3
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2–5 Register 1 Read Operation Timing Diagram
2–4
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2–6 Register 1 Write Operation Timing Diagram
2–5
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2–7 Internal Power-Down Logic
2–6
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2–8 Master Device Frame-Sync Signal With Primary and Secondary
Communications (No Slaves)
2–8
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2–9 Master Device Frame-Sync Signal With Primary and Secondary
Communications (With 1 Slave Device)
2–8
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2–10 Master Device FS and FSD Output When FSD Register (D0–D5,
Control 3 Register) is 0
2–9
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2–11 Master Device FS and FSD Output After Control 3 Register Is
Programmed (One Slave Device)
2–9
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2–12 Master With Slaves (To DSP Interface)
2–10
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2–13 Master-Slave Frame-Sync Timing After A Delay Has Been
Programmed Into The FSD Register (D0–D5 of Control 3 Register)
2–10
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2–14 Master Device FS and FSD Output After Control 3 Register
Is Programmed With 49H
2–11
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2–15 RC Antialias Filter
2–11
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2–16 INP and INM Internal Self-Biased (2.5 V) Circuit
2–12
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2–17 Differential Output Drive (Ground Referenced)
2–12
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2–18 Digital Input Code vs Analog Output Voltage
2–12
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3–1 Primary Serial Communication Timing
3–1
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3–2 Hardware and Software Methods to Make a Secondary Request
3–2
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3–3 FS Output When Hardware Secondary Serial Communication Is Requested
Only Once (No Slave)
3–3
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3–4 FS Output When Hardware Secondary Serial Communication Is Requested
Only Once (Three Slaves)
3–3
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3–5 FS Output During Software Secondary Serial Communication Request
(No Slave)
3–3
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3–6 Phone Mode Timing When Phone Mode Is Enabled
3–4
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相关PDF资料 |
PDF描述 |
|---|---|
| TLC320AD50IDW | SPECIALTY ANALOG CIRCUIT, PDSO28 |
| TLC320AD50CPTR | SPECIALTY ANALOG CIRCUIT, PQFP48 |
| TLC320AD50IPTR | SPECIALTY ANALOG CIRCUIT, PQFP48 |
| TLC320AD50IPT | SPECIALTY ANALOG CIRCUIT, PQFP48 |
| TLC555QDRQ1 | PULSE; RECTANGULAR, 1.2 MHz, TIMER, PDSO8 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| TLC320AD52CPT | 功能描述:IC ANALOG INTERFACE W/MS 48-LQFP RoHS:否 类别:集成电路 (IC) >> 接口 - 编解码器 系列:- 标准包装:2,500 系列:- 类型:PCM 数据接口:PCM 音频接口 分辨率（位）:15 b ADC / DAC 数量:1 / 1 三角积分调变:是 S/N 比，标准 ADC / DAC (db):- 动态范围，标准 ADC / DAC (db):- 电压 - 电源，模拟:2.7 V ~ 3.3 V 电压 - 电源，数字:2.7 V ~ 3.3 V 工作温度:-40°C ~ 85°C 安装类型:表面贴装 封装/外壳:80-VFBGA 供应商设备封装:80-BGA MICROSTAR JUNIOR（5x5） 包装:带卷 (TR) 其它名称:296-21257-2 |
| TLC320AD535 | 制造商:TI 制造商全称:Texas Instruments 功能描述:DUAL CHANNEL VOICE/DATA CODEC |
| TLC320AD535C | 制造商:TI 制造商全称:Texas Instruments 功能描述:DUAL CHANNEL VOICE/DATA CODEC |
| TLC320AD535C-I | 制造商:TI 制造商全称:Texas Instruments 功能描述:DUAL CHANNEL VOICE/DATA CODEC |
| TLC320AD535I | 制造商:TI 制造商全称:Texas Instruments 功能描述:DUAL CHANNEL VOICE/DATA CODEC |
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