参数资料
型号: TMP86FS64FG
元件分类: 微控制器/微处理器
英文描述: 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP100
封装: 20 X 14 MM, 0.65 MM PITCH, LEAD FREE, PLASTIC, QFP-100
文件页数: 47/253页
文件大小: 1801K
代理商: TMP86FS64FG
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TMP86FS64FG
12.3.4 Pulse Width Modulation (PWM) Output Mode
The pulse width modulation (PWM) output mode is used to generate the PWM pulse with up to 8 bits of res-
olution by an internal clock.
When a match between the up-counter and the TC5DR value is detected, the logic level output from the
PWM
5 pin becomes low. The up-counter continues counting. When the up-counter overflow occurs, the PWM5
pin becomes high. The INTTC5 interrupt request is generated at this time.
When the timer is stopped, the PWM5 pin is high. Therefore, if the timer is stopped when the PWM5 pin is
low, one PMW cycle may be shorter than the programmed value.
TC5DR is serially connected to the shift register. If TC5DR is programmed during PWM output, the data set
to TC5DR is not shifted until one PWM cycle is completed. Therefore, a pulse can be modulated periodically.
For the first time, the data written to TC5DR is shifted when the timer is started by setting TC5CR<TC5S> to
1.
Note 1: The PWM output mode can be used only in the NORMAL1/2 and IDEL 1/2 modes.
Note 2: In the PWM output mode, program TC5DR immediately after the INTTC5 interrupt request is generated
(typically in the INTTC5 interrupt service routine.) When the programming of TC5DR and the INTTC5 inter-
rupt occur at the same time, an unstable value is shifted, that may result in generation of pulse different
from the programmed value until the next INTTC5 interrupt request is issued.
Figure 12-3 PWM output Mode Timing Chart (TC5)
Internal clock
Shift register
Counter
n
0
?
1
n + 1
FF
0
1
n
n + 1
FF
01
m
PWM cycle
Match detect
mp
n
m
Data shift
Rewrite
Data shift
Match detect
Data shift
n
m
Rewrite
PWM5 pin
INTTC5
interrupt request
Timer F/F
TC5DR
TC5CR<TC5S>
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参数描述
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