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参数资料
| 型号： | TMP96C041AF |
| 元件分类： | 微控制器 |
| 英文描述： | 16-Bit Microcontroller |
| 中文描述： | 16位微控制器 |
| 文件页数： | 138/186页 |
| 文件大小： | 5215K |
| 代理商： | TMP96C041AF |
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138
TOSHIBA CORPORATION
TMP96C031N/F
3.11.1 Operation
(1)
Analog Reference Voltage
High analog reference voltage is applied to the VREF
pin.
The reference voltage between VREG and AGND is
divided by 256 using ladder resistance, and compared
with the analog input voltage for A/D conversion.
(2)
Analog Input Channels
Analog input channel is selected by ADMOD <ADCH1,
0>. However, in fixed analog input mode, one channel
is selected by ADMOD <ADCH1, 0> among four pins:
AN0 to AN3.
In analog input channel scan mode, the number of
channels to be scanned from AN0 is specified by
ADMOD <ADCH1, 0>, such as AN0
AN1
→
AN2, and AN0
→
AN1
When reset, A/D conversion channel register will be ini-
tialized to ADMOD <ADCH1, 0> = 00, so that AN0 pin
will be selected.
The pins which are not used as analog input channel
can be used as ordinary input port P5.
→
AN1, AN0
AN2
→
AN3.
→
→
(3)
Starting A/D Conversion
A/D conversion starts when A/D conversion register
ADMOD <ADS> is written “1". When A/D conversion
starts, A/D conversion busy flag ADMOD <ADBF>
which indicates “A/D conversion is in progress” will be
set to “1".
(4)
A/D Conversion Mode
Both fixed A/D conversion channel mode and A/D con-
version channel scan mode have two conversion
modes, i.e., single and repeat conversion modes.
In fixed channel repeat mode, conversion of specified
one channel is executed repeatedly.
In scan repeat mode, scanning from AN0,
executed repeatedly.
A/D conversion mode is selected by ADMOD <REPET,
SCAN>.
…
→
AN3 is
(5)
A/D Conversion Speed Selection
There are two A/D conversion speed modes: high
speed mode and low speed mode. The selection is
executed by ADMOD <ADCS> register.
When reset, ADMOD <ADCS> will be initialized to “0,”
so that high speed conversion mode will be selected.
(6)
A/D Conversion End and Interrupt
A/D conversion single mode
ADMOD <EOCF> for A/D conversion end will be set to
“1,” ADMOD <ADBF> flag will be reset to “0,” and
INTAD interrupt will be enabled when A/D conversion
of specified channel ends in fixed conversion channel
mode or when A/D conversion of the last channel ends
in channel scan mode.
(7)
Storing the A/D Conversion Result
The results of A/D conversion are stored in ADREG0 to
ADREG3 registers for each channel. In repeat mode,
the registers are updated whenever conversion ends.
ADREG0 to ADREG3 are read-only registers.
(8)
Reading the A/D Conversion Result
The results of A/D conversion are stored in ADREG0 to
ADREG3 registers. When the contents of one of
ADREG0 to ADREG3 registers are read, ADMOD
<EOCF> will be cleared to “0".
Setting example:
When the analog input volt-
age of the AN3 pin is A/D
converted and the result is
stored in the memory
address FF10H by A/D
interrupt INTAD routine.
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PDF描述 |
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