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参数资料
| 型号： | TMR320F2812PBKA |
| 厂商： | Texas Instruments, Inc. |
| 元件分类： | 数字信号处理 |
| 英文描述： | TMS320R2811, TMS320R2812 Digital Signal Processors |
| 中文描述： | TMS320R2811，TMS320R2812数字信号处理器 |
| 文件页数： | 126/147页 |
| 文件大小： | 2021K |
| 代理商： | TMR320F2812PBKA |
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Electrical Specifications
126
June 2004
SPRS257
Table 6
37. XHOLD/XHOLDA Timing Requirements (XCLKOUT =
1/2 XTIMCLK)
§
MIN
MAX
UNIT
t
d(HL-HiZ)
t
d(HL-HAL)
t
d(HH-HAH)
t
d(HH-BV)
When a low signal is detected on XHOLD, all pending XINTF accesses will be completed before the bus is placed in a high-impedance state.
The state of XHOLD is latched on the rising edge of XTIMCLK.
§
After the XHOLD is detected low or high, all bus transitions and XHOLDA transitions will occur with respect to the rising edge of XCLKOUT. Thus,
for this mode where XCLKOUT = 1/2 XTIMCLK, the transitions can occur up to 1 XTIMCLK cycle earlier than the maximum value specified.
Delay time, XHOLD low to Hi-Z on all Address, Data, and Control
Delay time, XHOLD low to XHOLDA low
Delay time, XHOLD high to XHOLDA high
Delay time, XHOLD high to Bus valid
4t
c(XTIM)+
t
c(XCO)
4t
c(XTIM
+2t
c(XCO)
ns
ns
ns
ns
4t
c(XTIM)
6t
c(XTIM)
á
á
á
á
á
á
á
XCLKOUT
(1/2 XTIMCLK)
XHOLD
XR/W,
XZCS0AND1,
XZCS2,
XZCS6AND7
XD[15:0]
Valid
XHOLDA
t
d(HL-HiZ)
t
d(HH-HAH)
High-Impedance
XA[18:0]
Valid
Valid
High-Impedance
t
d(HH-BV)
t
d(HL-HAL)
High-Impedance
See Note A
See Note B
NOTES:
A All pending XINTF accesses are completed.
B Normal XINTF operation resumes.
Figure 6
33. XHOLD/XHOLDA Timing Requirements (XCLKOUT = 1/2 XTIMCLK)
A
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PDF描述 |
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参数描述 |
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