参数资料
型号: TOOLSTICK520PP
厂商: Silicon Laboratories Inc
文件页数: 211/220页
文件大小: 0K
描述: ADAPTER PROGRAM TOOLSTICK F520
标准包装: 1
系列: ToolStick
类型: 微控制器编程器
适用于相关产品: C8051F520/521/523/524/526/527
所含物品: 2 个板和 USB 连接线缆
产品目录页面: 626 (CN2011-ZH PDF)
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其它名称: 336-1455
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C8051F52x/F53x
90
Rev. 1.4
8.3.1. Idle Mode
Setting the Idle Mode Select bit (PCON.0) causes the CIP-51 to halt the CPU and enter Idle mode as soon
as the instruction that sets the bit completes execution. All internal registers and memory maintain their
original data. All analog and digital peripherals can remain active during Idle mode.
Idle mode is terminated when an enabled interrupt is asserted or a reset occurs. The assertion of an
enabled interrupt will cause the Idle Mode Selection bit (PCON.0) to be cleared and the CPU to resume
operation. The pending interrupt will be serviced and the next instruction to be executed after the return
from interrupt (RETI) will be the instruction immediately following the one that set the Idle Mode Select bit.
If Idle mode is terminated by an internal or external reset, the CIP-51 performs a normal reset sequence
and begins program execution at address 0x0000.
If enabled, the Watchdog Timer (WDT) will eventually cause an internal watchdog reset and thereby termi-
nate the Idle mode. This feature protects the system from an unintended permanent shutdown in the event
of an inadvertent write to the PCON register. If this behavior is not desired, the WDT may be disabled by
software prior to entering the Idle mode if the WDT was initially configured to allow this operation. This pro-
vides the opportunity for additional power savings, allowing the system to remain in the Idle mode indefi-
nitely, waiting for an external stimulus to wake up the system.
8.3.2. Stop Mode
Setting the Stop Mode Select bit (PCON.1) causes the CIP-51 to enter Stop mode as soon as the instruc-
tion that sets the bit completes execution. In Stop mode the internal oscillator, CPU, and all digital peripher-
als are stopped; the state of the external oscillator circuit is not affected. Each analog peripheral (including
the external oscillator circuit) may be shut down individually prior to entering Stop Mode. Stop mode can
only be terminated by an internal or external reset. On reset, the CIP-51 performs the normal reset
sequence and begins program execution at address 0x0000.
If enabled, the Missing Clock Detector will cause an internal reset and thereby terminate the Stop mode.
The Missing Clock Detector should be disabled if the CPU is to be put to in STOP mode for longer than the
MCD timeout period of 100
s.
8.3.3. Suspend Mode
The C8051F52x/F52xA/F53x/F53xA devices feature a low-power Suspend mode, which stops the internal
oscillator until a wakening event occurs. See Section Section “14.1.1. Internal Oscillator Suspend Mode”
on page 136 for more information.
Note: When entering Suspend mode, firmware must set the ZTCEN bit in REF0CN (SFR Definition 5.1).
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PDF描述
R0.25D12-2412/H-R CONV DC/DC 0.25W 24VIN +/-12VOUT
EEC20DRAH CONN EDGECARD 40POS R/A .100 SLD
ECM15DRES CONN EDGECARD 30POS .156 EYELET
M7VXK-3710R D-SUB CABLE - MMU37K/MC37M/X
F971D156MNC CAP TANT 15UF 20V 20% 2917
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