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参数资料
| 型号： | TSC80C31-L16IBD |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, 16 MHz, MICROCONTROLLER, PQCC44 |
| 封装： | PLASTIC, LCC-44 |
| 文件页数： | 205/224页 |
| 文件大小： | 24907K |
| 代理商： | TSC80C31-L16IBD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页当前第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页
81
XMEGA D3 [DATASHEET]
Atmel-8134N-ATxmega32D3-64D3-128D3-192D3-256D3-384D3_datasheet–03/2014
Table 32-29. Two-wire interface characteristics.
Notes:
1.
Required only for f
SCL > 100kHz.
2.
C
b = Capacitance of one bus line in pF.
3.
f
PER = Peripheral clock frequency.
Symbol
Parameter
Condition
Min.
Typ.
Max.
Units
VIH
Input high voltage
0.7VCC
VCC + 0.5
V
IL
Input low voltage
-0.5
0.3V
CC
V
hys
Hysteresis of Schmitt trigger inputs
0.05V
CC
VOL
Output low voltage
3mA, sink current
0
0.4
tr
Rise time for both SDA and SCL
20 + 0.1Cb (1)(2)
300
ns
t
of
Output fall time from V
IHmin to VILmax
10pF < C
b < 400pF
20 + 0.1C
b
250
tSP
Spikes suppressed by input filter
0
50
II
Input current for each I/O pin
0.1VCC < VI < 0.9VCC
-10
10
A
C
I
Capacitance for each I/O pin
10
pF
fSCL
SCL clock frequency
0
400
kHz
RP
Value of pull-up resistor
f
SCL 100kHz
fSCL > 100kHz
tHD;STA
Hold time (repeated) START condition
f
SCL 100kHz
4.0
s
fSCL > 100kHz
0.6
t
LOW
Low period of SCL clock
fSCL 100kHz
4.7
f
SCL > 100kHz
1.3
t
HIGH
High period of SCL clock
f
SCL 100kHz
4.0
fSCL > 100kHz
0.6
tSU;STA
Set-up time for a repeated START
condition
f
SCL 100kHz
4.7
f
SCL > 100kHz
0.6
t
HD;DAT
Data hold time
fSCL 100kHz
0
3.45
f
SCL > 100kHz
0
0.9
t
SU;DAT
Data setup time
f
SCL 100kHz
250
fSCL > 100kHz
100
tSU;STO
Setup time for STOP condition
f
SCL 100kHz
4.0
f
SCL > 100kHz
0.6
t
BUF
Bus free time between a STOP and
START condition
fSCL 100kHz
4.7
f
SCL > 100kHz
1.3
V
CC
0.4V
–
3mA
----------------------------
100ns
C
b
---------------
300ns
C
b
---------------
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