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参数资料
| 型号： | TSS461E-TERA-9 |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | VAN Data Link Controller |
| 中文描述： | 1 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PDSO24 |
| 封装： | SO-24 |
| 文件页数： | 28/57页 |
| 文件大小： | 817K |
| 代理商： | TSS461E-TERA-9 |
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28
TSS461E
4194B–AUTO–12/04
IDLE: Idle Command
If the user sets the Idle bit, the circuit will enter idle mode. In idle mode the oscillator will
operate, but the TSS461E will not transmit or receive anything on the bus, and the TXD
output will be in three-state
One: Idle active
Zero: Idle inactive
ACTI: Activate Command
The Activate command will put the circuit in the active mode, i.e it will transmit
receive normally on the bus. When the circuit is in activate mode the TXD three-state
output is enabled.
and
One: Activate active
Zero: Activate inactive
REAR: Re-Arbitrate Command
This command will, after the current attempt, reset the retry counter and re-arbitrate the
messages to be transmitted in order to find the highest priority message to transmit.
One: Re-arbitrate active
Zero: Re-arbitrate inactive
MSDC: Manual System
Diagnosis Clock
Rather than using the SDC divider described in section “Diagnosis Control Register
(0x02)”, the user can use the manual SDC command to generate a SDC pulse for the
diagnosis system.
This MSDC pulse should be high at least two timeslot clock.
Line Status Register (0x04)
Read only register.
Default value after reset: 0bx01xxx00.
This register reports the operation mode of the TSS461E in the Sleep an Idle bits
(Command Register located at address 0y03) as well as the diagnosis system
status bits S2 to S0 discussed in section “Diagnosis System”.
SPG: Sleeping
IDG: Idling
Default mode at reset
Sa, Sb and Sc
Diagnosis system status bits
Sa and Sb
7
6
5
4
3
2
1
0
x
SPG
IDG
Sc
Sb
Sa
TXG
RXG
相关PDF资料 |
PDF描述 |
|---|---|
| TSS461E-TRDZ-9 | VAN Data Link Controller |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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