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参数资料
| 型号： | TSS461E-TRDZ-9 |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | VAN Data Link Controller |
| 中文描述： | 1 CHANNEL(S), 1M bps, SERIAL COMM CONTROLLER, PDSO24 |
| 封装： | SO-24 |
| 文件页数： | 24/57页 |
| 文件大小： | 817K |
| 代理商： | TSS461E-TRDZ-9 |
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24
TSS461E
4194B–AUTO–12/04
Control and Status Registers
Line Control Register (0x00)
Read/write register.
Default value after reset: 0y00
reserved: Bit 2, this bit cannot be set by the user; a 0 must always be written to this
bit.
CD[3:0] Clock Divider
They control the VAN Bus rate through a Baud Rate generator according to
mula below:
the
for-
PC Pulsed CodeOne
The TSS461E will transmit and receive data using the pulsed coding mode (i.e optical
or radio link mode). The use of this mode implies communication via the RXD0 input
and the non-functionality of the diagnosis system.
Zero: (default at reset) The TSS461E will transmit and receive data using the Enhanced
Manchester code (RXD0, RXD1, RXD2).
IVTX
Invert TXD output.
IVRX
Invert RXD inputs.The user can invert the logical levels used on either the TXD output or
the RXD inputs in order to adapt to different line drivers and receivers.
One: A one on either of these bits will invert the respective signals.
Zero: (default at reset). The TSS461E will set TXD to recessive state in Idle mode and
consider the bus free (recessive states on RXD inputs).
Transmit Control Register
(0x01)
Read/Write register
Default value after reset: 0x02
7
6
5
4
3
2
1
0
MR3
MR2
MR1
MR0
VER2
VER1
VER0
MT
F
TSCLK
F
1
n
16
------------------
=
7
6
5
4
3
2
1
0
MR3
MR2
MR1
MR0
VER2
VER1
VER0
MT
相关PDF资料 |
PDF描述 |
|---|---|
| TSS461F | VAN Data Link Controller |
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相关代理商/技术参数 |
参数描述 |
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