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参数资料
| 型号： | UPD178F124 |
| 英文描述： | 78K/0 Series for Instructions | User＇s Manual[10/2001] |
| 中文描述： | 78K线/ 0系列说明|用户手册[10/2001] |
| 文件页数： | 113/129页 |
| 文件大小： | 644K |
| 代理商： | UPD178F124 |
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CHAPTER 5 EXPLANATION OF INSTRUCTIONS
User's Manual U12326EJ4V0UM
Decimal Adjust Register for Subtraction
ADJBS
Decimal Adjustment of Subtraction Result
[Instruction format]
ADJBS
[Operation]
Decimal Adjust Accumulator for Subtraction
[Operand]
None
[Flag]
ZAC
CY
×××
[Description]
The A register, CY flag and AC flag are decimally adjusted from their contents. This instruction carries out
an operation having meaning only when the BCD (binary coded decimal) data is subtracted and the
subtraction result is stored in the A register (in all other cases, the instruction carries out an operation having
no meaning).
See the table below for the adjustment method.
If the adjustment result shows that the A register contents are 0, the Z flag is set (1). In all other cases,
the Z flag is cleared (0).
Condition
Operation
AC = 0
CY = 0
A
← A, CY ← 0, AC ← 0
CY = 1
A
← A–01100000B, CY ← 1, AC ← 0
AC = 1
CY = 0
A
← A–00000110B, CY ← 0, AC ← 0
CY = 1
A
← A–01100110B, CY ← 1, AC ← 0
相关PDF资料 |
PDF描述 |
|---|---|
| UPD178F098GF-3BA-A | 8-BIT, FLASH, MICROCONTROLLER, PQFP100 |
| UPD17P136BGT | MICROCONTROLLER, PDSO28 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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