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参数资料
| 型号： | V54C3128804VAS7PC |
| 厂商： | MOSEL-VITELIC |
| 元件分类： | DRAM |
| 英文描述： | 16M X 8 SYNCHRONOUS DRAM, 5.4 ns, PBGA60 |
| 封装： | SOC-60 |
| 文件页数： | 10/49页 |
| 文件大小： | 696K |
| 代理商： | V54C3128804VAS7PC |
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V54C3128(16/80/40)4V(T/S) Rev.1.5 March 2003
MOSEL VITELIC
V54C3128(16/80/40)4V(T/S)
Timing Diagrams
1. Bank Activate Command Cycle
2. Burst Read Operation
3. Read Interrupted by a Read
4. Read to Write Interval
4.1 Read to Write Interval
4.2 Minimum Read to Write Interval
4.3 Non-Minimum Read to Write Interval
5. Burst Write Operation
6. Write and Read Interrupt
6.1 Write Interrupted by a Write
6.2 Write Interrupted by Read
7. Burst Write & Read with Auto-Precharge
7.1 Burst Write with Auto-Precharge
7.2 Burst Read with Auto-Precharge
8. Burst Termination
8.1 Termination of a Burst Write Operation
8.2 Termination of a Burst Write Operation
9. AC- Parameters
9.1 AC Parameters for a Write Timing
9.2 AC Parameters for a Read Timing
10. Mode Register Set
11. Power on Sequence and Auto Refresh (CBR)
12. Power Down Mode
13. Self Refresh (Entry and Exit)
14. Auto Refresh (CBR)
相关PDF资料 |
PDF描述 |
|---|---|
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| V54C3256164VAT6 | 16M X 16 SYNCHRONOUS DRAM, 5.4 ns, PDSO54 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| V54C3128804VAT8 | 制造商:MOSEL 制造商全称:MOSEL 功能描述:HIGH PERFORMANCE 143/133/125MHz 3.3 VOLT 16M X 8 SYNCHRONOUS DRAM 4 BANKS X 4Mbit X 8 |
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| V54C3128804VBJ7IPC | 制造商:Mosel Vitelic Corporation 功能描述: |
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