参数资料
型号: W6811IWG
厂商: WINBOND ELECTRONICS CORP
元件分类: 编解码器
英文描述: A/MU-LAW, PCM CODEC, PDSO24
封装: 4.40 X 7.80 MM, ROHS COMPLIANT, PLASTIC, TSSOP1-24
文件页数: 9/37页
文件大小: 589K
代理商: W6811IWG
W6811
Publication Release Date: September, 2005
- 17 -
Revision A12
FST
BCLKT
PCMT
PCMR
D7 D6 D5 D4 D3 D2 D1 D0
D7 D6 D5 D4 D3 D2
D1 D0
D7 D6 D5 D4 D3 D2 D1 D0
D7 D6 D5 D4 D3 D2
D1 D0
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
T
FS
T
FSRH
T
FSFH
T
FSRS
T
BDTD
T
BDTD
T
BDTD
T
BDTD
T
HID
T
HID
T
DRS
T
DRS
T
DRH
T
DRH
BCH = 0
B1 Channel
BCH = 1
B2 Channel
MSB
LSB
T
BCK
T
BCKH
T
BCKL
-1
Figure 8.3 IDL PCM Timing
SYMBOL
DESCRIPTION
MIN
TYP
MAX
UNIT
1/TFS
FST Frequency
---
8
---
kHz
1/TBCK
BCLKT Frequency
256
---
4096
kHz
TBCKH
BCLKT HIGH Pulse Width
50
---
ns
TBCKL
BCLKT LOW Pulse Width
50
---
ns
TFSRH
BCLKT –1 Falling Edge to FST Rising
Edge Hold Time
20
---
ns
TFSRS
FST Rising Edge to BCLKT 0 Falling edge
Setup Time
60
---
ns
TFSFH
BCLKT 0 Falling Edge to FST Falling Edge
Hold Time
20
---
ns
TBDTD
BCLKT Rising Edge to Valid PCMT Delay
Time
10
---
60
ns
THID
Delay Time from the BCLKT 8 Falling
Edge (B1 channel) or BCLKT 18 Falling
Edge (B2 Channel) to PCMT Output High
Impedance
10
---
50
ns
TDRS
Valid PCMR to BCLKT Falling Edge Setup
Time
20
---
ns
TDRH
PCMR Hold Time from BCLKT Falling
Edge
75
---
ns
Table 8.3 IDL PCM Timing Parameters
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PDF描述
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参数描述
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