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参数资料
| 型号： | W9825G6JH-6 |
| 厂商： | WINBOND ELECTRONICS CORP |
| 元件分类： | DRAM |
| 英文描述： | 16M X 16 SYNCHRONOUS DRAM, 5 ns, PDSO54 |
| 封装： | 0.400 INCH, 0.80 MM PITCH, ROHS COMPLIANT, TSOP2-54 |
| 文件页数： | 13/42页 |
| 文件大小： | 708K |
| 代理商： | W9825G6JH-6 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页当前第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页
W9825G6JH
Publication Release Date: Oct. 25, 2010
- 20 -
Revision A02
10.4 Mode Register Set Cycle
A0
A3
Addressing Mode
0
Sequential
1
Interleave
A0
A9
Single Write Mode
0
Burst read and Burst write
1
Burst read and single write
A0
A2
A1
A0
0
A0
0
1
A0
0
1
0
A0
0
1
A0
1
0
A0
1
0
1
A0
1
0
A0
1
Burst Length
Sequential
Interleave
1
2
4
8
Reserved
Full Page
CAS Latency
Reserved
2
3
Reserved
A0
A6
A5
A4
A0
0
A0
0
1
0
A0
0
1
A0
1
0
A0
0
1
* "Reserved" should stay "0" during MRS cycle.
tRSC
tCMS
tCMH
tCMS
tCMH
tCMS
tCMH
tCMS
tCMH
tAS
tAH
CLK
CS
RAS
CAS
WE
A0-A12
BS0,1
Register
set data
next
command
A0
A1
A2
A3
A4
A5
A6
Burst Length
Addressing Mode
CAS Latency
(Test Mode)
A8
A0
A7
A9
A0
Write Mode
A10
A12
A0
A11
"0"
Reserved
BS0
"0"
Reserved
BS1
"0"
相关PDF资料 |
PDF描述 |
|---|---|
| W9825G6JH-5 | 16M X 16 SYNCHRONOUS DRAM, 5 ns, PDSO54 |
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相关代理商/技术参数 |
参数描述 |
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