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参数资料
| 型号： | WBLXT9785HED0 |
| 厂商： | INTEL CORP |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| 封装： | ROHS COMPLIANT, PLASTIC, HQFP-208 |
| 文件页数： | 121/234页 |
| 文件大小： | 3982K |
| 代理商： | WBLXT9785HED0 |
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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
Datasheet
207
Document Number: 249241
Revision Number: 010
Revision Date: 30-May-2006
Table 91. Auto-Negotiation Link Partner Next Page Receive Register (Address 8)
Bit
Name
Description
Type1
Default2
15
Next Page
(NP)
0 = Link partner has no additional next pages to send
1 = Link partner has additional next pages to send
R0
14
Acknowledge
(ACK)
0 = Link partner has not received Link Code Word from
the LXT9785/LXT9785E
1 = Link partner has received Link Code Word from the
LXT9785/LXT9785E
R0
13
Message Page
(MP)
0 = Page sent by the link partner is an unformatted page
1 = Page sent by the link partner is a message page
R0
12
Acknowledge 2
(ACK2)
0 = Link partner cannot comply with the message
1 = Link partner complies with the message
R0
11
Toggle
(T)
0 = Previous value of the transmitted Link Code Word
equalled logic one
1 = Previous value of the transmitted Link Code Word
equalled logic zero
R0
10:0
Message/
Unformatted
Code Field
MP = 1: Code interpreted as message page
MP = 0: Code interpreted as unformatted page
R0x000
1. R = Read Only
2. Default value at the start of auto-negotiation code word transmission.
Table 92. Port Configuration Register (Address 16, Hex 10) (Sheet 1 of 2)
Bit
Name
Description
Type
1
Default
15
Reserved
Write as 0, ignore on Read
R/W
0
14
Link Disable
0 = Normal operation
1 = Force link pass (sets appropriate registers and LEDs
to pass)
Note:
Setting this bit in 100 Mbps mode by-passes the
descrambler lock requirement to establish link and forces
the link to the link-good state. Setting this bit produces
unreliable results if the descrambler is not locked,
R/W
0
13
Transmit Disable
0 = Normal operation
1 = Disable twisted-pair transmitter
R/W
0
12
Bypass Scramble
(100BASE-TX)
0 = Normal operation
1 = Bypass scrambler and descrambler
R/W
0
11
Reserved
Write as 0, ignore on Read
R/W
0
1. R/W = Read/Write
2. LSHR = Default value is derived from a single device input pin state or a group of device input pin states as
the pin(s) are latched at startup or hardware reset.
3. The default value of Register bit 16.0 is determined by the G_FX/TP_L pin.
If G_FX/TP_L is tied Low, the default value of Register bit 16.0 = 0. If G_FX/TP_L is not tied Low, the
default value of Register bit 16.0 = 1. The BGA15 package does not have a G_FX/TP_L hardware
configuration pin.
4. The default value of Register bit 16.5 is determined by the PREASEL pin. The BGA15 package does not
have a PREASEL hardware configuration pin and has a default of 0.
5. The BGA15 package does not support fiber. Default for the BGA15 package is 0.
6. NA means the bits do not have a default value and may initially contain any value.
相关PDF资料 |
PDF描述 |
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参数描述 |
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| WBM-DISHWASH | 制造商:Thomas & Betts 功能描述: |
| WBM-DISPOSAL | 制造商:Thomas & Betts 功能描述: |
| WBM-DUPLEX | 制造商:Thomas & Betts 功能描述: |
| WBM-DUPLEXHD | 制造商:Thomas & Betts 功能描述: |
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