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参数资料
| 型号： | WJLXT971ALE.A4-857343 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封装： | 10 X 10 MM, 1.40 MM HEIGHT, ROHS COMPLIANT, LQFP-64 |
| 文件页数： | 9/80页 |
| 文件大小： | 931K |
| 代理商： | WJLXT971ALE.A4-857343 |
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Page 17
Cortina Systems LXT972A Single-Port 10/100 Mbps PHY Transceiver
LXT972A PHY
Datasheet
249186, Revision 5.2
13 September 2007
4.0 Signal Descriptions
.
Table 6
MII Controller Interface Signal Descriptions
LQFP
Pin#
Symbol
Type
Signal Description5
3
MDDIS
I
Management Data Disable.
When MDDIS is High, the MDIO is disabled from read and write
operations.
When MDDIS is Low at power-up or reset, the Hardware Control
Interface pins control only the initial or “default” values of their respective
register bits.
After the power-up/reset cycle is complete, bit control reverts to the
MDIO serial channel.
43
MDC
I
Management Data Clock.
Clock for the MDIO serial data channel.
Maximum frequency is 8 MHz.
42
MDIO
I/O
Management Data Input/Output.
Bidirectional serial data channel for PHY/STA communication.
64
MDINT_L
OD
Management Data Interrupt.
When register bit 18.1 = 1, a Low output on this active-low pin indicates a
status change.
Interrupt is cleared by reading Register 19.
Table 7
LXT972A: Network Interface Signal Descriptions
LQFP
Pin#
Symbol
Type
Signal Description
19
20
TPOP
TPON
O
Twisted-Pair Outputs, Positive and Negative.
During 100BASE-TX or 10BASE-T operation, TPOP/N pins drive IEEE
802.3 compliant pulses onto the line.
23
24
TPIP
TPIN
I
Twisted-Pair Inputs, Positive and Negative.
During 100BASE-TX or 10BASE-T operation, TPIP/N pins receive
differential 100BASE-TX or 10BASE-T signals from the line.
Table 8
LXT972A: Standard Bus and Interface Signal Descriptions
LQFP
Pin#
Symbol
Type
Signal Description
12
ADDR0
I
Address 0.
Sets device address.
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