参数资料
| 型号： | XC2S200-6PQ208C |
| 厂商： | Xilinx Inc |
| 文件页数： | 52/99页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 2.5V C-TEMP 208-PQFP |
| 标准包装： | 24 |
| 系列： | Spartan®-II |
| LAB/CLB数： | 1176 |
| 逻辑元件/单元数： | 5292 |
| RAM 位总计： | 57344 |
| 输入/输出数： | 140 |
| 门数： | 200000 |
| 电源电压： | 2.375 V ~ 2.625 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 208-BFQFP |
| 供应商设备封装： | 208-PQFP（28x28） |
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Spartan-II FPGA Family: DC and Switching Characteristics
DS001-3 (v2.8) June 13, 2008
Module 3 of 4
Product Specification
56
R
IOB Input Switching Characteristics(1)
Input delays associated with the pad are specified for LVTTL levels. For other standards, adjust the delays with the values
Symbol
Description
Device
Speed Grade
Units
-6
-5
Min
Max
Min
Max
Propagation Delays
TIOPI
Pad to I output, no delay
All
-
0.8
-
1.0
ns
TIOPID
Pad to I output, with delay
All
-
1.5
-
1.8
ns
TIOPLI
Pad to output IQ via transparent latch,
no delay
All
-
1.7
-
2.0
ns
TIOPLID
Pad to output IQ via transparent latch,
with delay
XC2S15
-
3.8
-
4.5
ns
XC2S30
-
3.8
-
4.5
ns
XC2S50
-
3.8
-
4.5
ns
XC2S100
-
3.8
-
4.5
ns
XC2S150
-
4.0
-
4.7
ns
XC2S200
-
4.0
-
4.7
ns
Sequential Delays
TIOCKIQ
Clock CLK to output IQ
All
-
0.7
-
0.8
ns
Setup/Hold Times with Respect to Clock CLK(2)
TIOPICK / TIOICKP
Pad, no delay
All
1.7 / 0
-
1.9 / 0
-
ns
TIOPICKD / TIOICKPD Pad, with delay(1)
XC2S15
3.8 / 0
-
4.4 / 0
-
ns
XC2S30
3.8 / 0
-
4.4 / 0
-
ns
XC2S50
3.8 / 0
-
4.4 / 0
-
ns
XC2S100
3.8 / 0
-
4.4 / 0
-
ns
XC2S150
3.9 / 0
-
4.6 / 0
-
ns
XC2S200
3.9 / 0
-
4.6 / 0
-
ns
TIOICECK / TIOCKICE ICE input
All
0.9 / 0.01
-
0.9 / 0.01
-
ns
Set/Reset Delays
TIOSRCKI
SR input (IFF, synchronous)
All
-
1.1
-
1.2
ns
TIOSRIQ
SR input to IQ (asynchronous)
All
-
1.5
-
1.7
ns
TGSRQ
GSR to output IQ
All
-
9.9
-
11.7
ns
Notes:
1.
Input timing for LVTTL is measured at 1.4V. For other I/O standards, see the table "Delay Measurement Methodology," page 60.
2.
A zero hold time listing indicates no hold time or a negative hold time.
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参数描述 |
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