参数资料
| 型号： | XC2S50-6TQ144C |
| 厂商： | Xilinx Inc |
| 文件页数： | 19/99页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 2.5V C-TEMP 144-TQFP |
| 标准包装： | 60 |
| 系列： | Spartan®-II |
| LAB/CLB数： | 384 |
| 逻辑元件/单元数： | 1728 |
| RAM 位总计： | 32768 |
| 输入/输出数： | 92 |
| 门数： | 50000 |
| 电源电压： | 2.375 V ~ 2.625 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-TQFP（20x20） |
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Spartan-II FPGA Family: Functional Description
DS001-2 (v2.8) June 13, 2008
Module 2 of 4
Product Specification
26
R
Figure 20: Slave Parallel Write Timing
Figure 21: Slave Parallel Write Abort Waveforms
DS001_20_061200
CCLK
No Write
Write
No Write
Write
DATA[7:0]
CS
WRITE
TSMDCC
TSMCCD
TSMCKBY
TSMCCCS
TSMWCC
TSMCCW
TSMCSCC
BUSY
Symbol
Description
Units
TSMDCC
CCLK
D0-D7 setup/hold
5
ns, min
TSMCCD
D0-D7 hold
0
ns, min
TSMCSCC
CS setup
7
ns, min
TSMCCCS
CS hold
0
ns, min
TSMCCW
WRITE setup
7
ns, min
TSMWCC
WRITE hold
0
ns, min
TSMCKBY
BUSY propagation delay
12
ns, max
FCC
Maximum frequency
66
MHz, max
FCCNH
Maximum frequency with no handshake
50
MHz, max
DS001_21_032300
CCLK
CS
WRITE
Abort
DATA[7:0]
BUSY
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