参数资料
| 型号： | XC3S1500L-4FGG676C |
| 厂商： | Xilinx Inc |
| 文件页数： | 224/272页 |
| 文件大小： | 0K |
| 描述： | SPARTAN-3A FPGA 1.5M STD 676FBGA |
| 产品变化通告： | Product Discontinuation Notice 14/May/2007 |
| 标准包装： | 1 |
| 系列： | Spartan®-3 |
| LAB/CLB数： | 2816 |
| 逻辑元件/单元数： | 29952 |
| RAM 位总计： | 589824 |
| 输入/输出数： | 487 |
| 门数： | 1500000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 676-BGA |
| 供应商设备封装： | 676-FBGA（27x27） |
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Spartan-3 FPGA Family: Functional Description
DS099 (v3.1) June 27, 2013
Product Specification
55
Initial Spartan-3 FPGA mask revisions have a limit on how fast the VCCO supply can ramp. The minimum allowed VCCO ramp
rate appears as TCCO in Table 30, page 60. The minimum rate is affected by the package inductance. Consequently, the ball
grid array and chip-scale packages (CP132, FT256, FG456, FG676, and FG900) allow a faster ramp rate than the quad-flat
packages (VQ100, TQ144, and PQ208).
Configuration Data Retention, Brown-Out
The FPGA’s configuration data is stored in robust CMOS configuration latches. The data in these latches is retained even
when the voltages drop to the minimum levels necessary to preserve RAM contents. This is specified in Table 31, page 60.
If, after configuration, the VCCAUX or VCCINT supply drops below its data retention voltage, clear the current device
configuration using one of the following methods:
Force the VCCAUX or VCCINT supply voltage below the minimum Power On Reset (POR) voltage threshold Table 29,
page 59).
Assert PROG_B Low.
The POR circuit does not monitor the VCCO_4 supply after configuration. Consequently, dropping the VCCO_4 voltage
does not reset the device by triggering a Power-On Reset (POR) event.
No Internal Charge Pumps or Free-Running Oscillators
Some system applications are sensitive to sources of analog noise. Spartan-3 FPGA circuitry is fully static and does not
employ internal charge pumps.
The CCLK configuration clock is active during the FPGA configuration process. After configuration completes, the CCLK
oscillator is automatically disabled unless the Bitstream Generator (BitGen) option Persist=Yes. See Module 4: Table 80,
Spartan-3 FPGAs optionally support a featured called Digitally Controlled Impedance (DCI). When used in an application,
the DCI logic uses an internal oscillator. The DCI logic is only enabled if the FPGA application specifies an I/O standard that
requires DCI (LVDCI_33, LVDCI_25, etc.). If DCI is not used, the associated internal oscillator is also disabled.
In summary, unless an application uses the Persist=Yes option or specifies a DCI I/O standard, an FPGA with no external
switching remains fully static.
相关PDF资料 |
PDF描述 |
|---|---|
| XC3S4000L-4FGG900C | SPARTAN-3A FPGA 4M STD 900-FBGA |
| AMM36DRMD-S288 | CONN EDGECARD 72POS .156 EXTEND |
| FMC20DRES | CONN EDGECARD 40POS .100 EYELET |
| IDT71342LA55PF8 | IC SRAM 32KBIT 55NS 64TQFP |
| IDT71421SA35PF8 | IC SRAM 16KBIT 35NS 64TQFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| XC3S1600E | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family: Complete Data Sheet |
| XC3S1600E-4CP132C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4CP132I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4CPG132C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4CPG132I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
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