参数资料
| 型号： | XC3S400-5TQG144C |
| 厂商： | Xilinx Inc |
| 文件页数： | 10/272页 |
| 文件大小： | 0K |
| 描述： | SPARTAN-3A FPGA 400K 144-TQFP |
| 产品培训模块： | Extended Spartan 3A FPGA Family |
| 标准包装： | 60 |
| 系列： | Spartan®-3 |
| LAB/CLB数： | 896 |
| 逻辑元件/单元数： | 8064 |
| RAM 位总计： | 294912 |
| 输入/输出数： | 97 |
| 门数： | 400000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-TQFP（20x20） |
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DS099 (v3.1) June 27, 2013
Product Specification
107
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in the United States and other countries. PCI and PCI-X are trademarks of PCI-SIG and used under license. All other trademarks are the property of their respective owners.
Introduction
This data sheet module describes the various pins on a Spartan-3 FPGA and how they connect to the supported
component packages.
The Pin Types section categorizes all of the FPGA pins by their function type.
The Pin Definitions section provides a top-level description for each pin on the device.
The Detailed, Functional Pin Descriptions section offers significantly more detail about each pin, especially for the dual-
or special-function pins used during device configuration.
Some pins have associated behavior that is controlled by settings in the configuration bitstream. These options are
described in the Bitstream Options section.
The Package Overview section describes the various packaging options available for Spartan-3 FPGAs. Detailed pin
list tables and footprint diagrams are provided for each package solution.
Pin Descriptions
Pin Types
A majority of the pins on a Spartan-3 FPGA are general-purpose, user-defined I/O pins. There are, however, up to 12
different functional types of pins on Spartan-3 device packages, as outlined in Table 69. In the package footprint drawings
that follow, the individual pins are color-coded according to pin type as in the table.
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Spartan-3 FPGA Family:
Pinout Descriptions
DS099 (v3.1) June 27, 2013
Product Specification
Table 69: Types of Pins on Spartan-3 FPGAs
Pin Type/
Color Code
Description
Pin Name
I/O
Unrestricted, general-purpose user-I/O pin. Most pins can be paired together to
form differential I/Os.
IO,
IO_Lxxy_#
DUAL
Dual-purpose pin used in some configuration modes during the configuration
process and then usually available as a user I/O after configuration. If the pin is not
used during configuration, this pin behaves as an I/O-type pin. There are 12
dual-purpose configuration pins on every package. The INIT_B pin has an internal
pull-up resistor to VCCO_4 or VCCO_BOTTOM during configuration.
IO_Lxxy_#/DIN/D0, IO_Lxxy_#/D1,
IO_Lxxy_#/D2, IO_Lxxy_#/D3,
IO_Lxxy_#/D4, IO_Lxxy_#/D5,
IO_Lxxy_#/D6, IO_Lxxy_#/D7,
IO_Lxxy_#/CS_B,
IO_Lxxy_#/RDWR_B,
IO_Lxxy_#/BUSY/DOUT,
IO_Lxxy_#/INIT_B
CONFIG
Dedicated configuration pin. Not available as a user-I/O pin. Every package has
seven dedicated configuration pins. These pins are powered by VCCAUX and have
a dedicated internal pull-up resistor to VCCAUX during configuration.
CCLK, DONE, M2, M1, M0,
PROG_B, HSWAP_EN
JTAG
Dedicated JTAG pin. Not available as a user-I/O pin. Every package has four
dedicated JTAG pins. These pins are powered by VCCAUX and have a dedicated
internal pull-up resistor to VCCAUX during configuration.
TDI, TMS, TCK, TDO
DCI
Dual-purpose pin that is either a user-I/O pin or used to calibrate output buffer
impedance for a specific bank using Digital Controlled Impedance (DCI). There are
two DCI pins per I/O bank.
IO/VRN_#
IO_Lxxy_#/VRN_#
IO/VRP_#
IO_Lxxy_#/VRP_#
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| XC3S400-5TQG144I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3 FPGA Family: Complete Data Sheet |
| XC3S400-5VQ100C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3 FPGA |
| XC3S400-5VQ100I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3 FPGA |
| XC3S400-5VQG100C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3 FPGA Family: Complete Data Sheet |
| XC3S400-5VQG100I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3 FPGA Family: Complete Data Sheet |
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