参数资料
| 型号： | XC3S50-4VQG100I |
| 厂商： | Xilinx Inc |
| 文件页数： | 13/272页 |
| 文件大小： | 0K |
| 描述： | SPARTAN-3A FPGA 50K STD 100-VQFP |
| 产品培训模块： | Extended Spartan 3A FPGA Family |
| 标准包装： | 90 |
| 系列： | Spartan®-3 |
| LAB/CLB数： | 192 |
| 逻辑元件/单元数： | 1728 |
| RAM 位总计： | 73728 |
| 输入/输出数： | 63 |
| 门数： | 50000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-VQFP（14x14） |
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Spartan-3 FPGA Family: Functional Description
DS099 (v3.1) June 27, 2013
Product Specification
11
X-Ref Target - Figure 7
Figure 7: Simplified IOB Diagram
D
CE
CK
TFF1
Three-state Path
T
T1
TCE
T2
TFF2
Q
SR
DDR
MUX
REV
D
CE
CK
Q
SR
REV
D
CE
CK
OFF1
Output Path
O1
OCE
O2
OFF2
Q
SR
DDR
MUX
Keeper
Latch
VCCO
VREF
Pin
I/O Pin
from
Adjacent
IOB
DS099-2_01_091410
I/O
Pin
Program-
mable
Output
Driver
DCI
ESD
Pull-Up
Pull-
Down
ESD
REV
D
CE
CK
Q
SR
REV
OTCLK1
OTCLK2
D
CE
CK
IFF1
Input Path
I
ICE
IFF2
Q
SR
LVCMOS, LVTTL, PCI
Single-ended Standards
using VREF
Differential Standards
REV
D
CE
CK
Q
SR
REV
ICLK1
ICLK2
SR
REV
Note: All IOB signals originating from the FPGA's internal logic have an optional polarity inverter.
IQ1
IQ2
Fixed
Delay
Fixed
Delay
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