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参数资料
| 型号： | XC3S500E-4FTG256C |
| 厂商： | Xilinx Inc |
| 文件页数： | 8/227页 |
| 文件大小： | 0K |
| 描述： | IC SPARTAN-3E FPGA 500K 256-FTBG |
| 产品培训模块： | FPGAs Spartan3 |
| 标准包装： | 90 |
| 系列： | Spartan®-3E |
| LAB/CLB数： | 1164 |
| 逻辑元件/单元数： | 10476 |
| RAM 位总计： | 368640 |
| 输入/输出数： | 190 |
| 门数： | 500000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-FTBGA |
| 配用： | 122-1536-ND - KIT STARTER SPARTAN-3E |
| 其它名称： | 122-1485 |
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Spartan-3E FPGA Family: Functional Description
DS312 (v4.1) July 19, 2013
Product Specification
105
X-Ref Target - Figure 67
Figure 67: Boundary-Scan Configuration Flow Diagram
Sample
mode pins
(JTAG port becomes
available)
Clear
configuration
memory
No
Yes
No
Power-On
CRC
correct?
Load CFG_IN
instruction
Reconfigure?
Load JSTART
instruction
Synchronous
TAP reset
(Clock five 1's
on TMS)
Start-Up
sequence
User mode
INIT_B = High?
PROG_B = Low
Load
JPROG
instruction
Yes
Load configuration
data frames
VCCINT >1V
and VCCAUX > 2V
and VCCO Bank 2 > 1V
INIT_B goes Low.
Abort Start-Up
Set PROG_B Low
after Power-On
DS312-2_59_051706
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PDF描述 |
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参数描述 |
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