参数资料
| 型号： | XC4044XL-3BG432C |
| 厂商： | Xilinx Inc |
| 文件页数： | 61/68页 |
| 文件大小： | 0K |
| 描述： | IC FPGA C-TEMP 3.3V 3SPD 432MBGA |
| 产品变化通告： | XC4000XL/E, XC9500XV, XC3100A Discontinuance 12/Apr/2010 |
| 标准包装： | 21 |
| 系列： | XC4000E/X |
| LAB/CLB数： | 1600 |
| 逻辑元件/单元数： | 3800 |
| RAM 位总计： | 51200 |
| 输入/输出数： | 320 |
| 门数： | 44000 |
| 电源电压： | 3 V ~ 3.6 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 432-LBGA，金属 |
| 供应商设备封装： | 432-MBGA（40x40） |
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R
XC4000E and XC4000X Series Field Programmable Gate Arrays
6-68
May 14, 1999 (Version 1.6)
Conguration Switching Characteristics
Master Modes (XC4000E/EX)
Master Modes (XC4000XL)
Slave and Peripheral Modes (All)
Description
Symbol
Min
Max
Units
Power-On Reset
M0 = High
TPOR
10
40
ms
M0 = Low
TPOR
40
130
ms
Program Latency
TPI
30
200
s per
CLB column
CCLK (output) Delay
TICCK
40
250
s
CCLK (output) Period, slow
TCCLK
640
2000
ns
CCLK (output) Period, fast
TCCLK
80
250
ns
Description
Symbol
Min
Max
Units
Power-On Reset
M0 = High
TPOR
10
40
ms
M0 = Low
TPOR
40
130
ms
Program Latency
TPI
30
200
s per
CLB column
CCLK (output) Delay
TICCK
40
250
s
CCLK (output) Period, slow
TCCLK
540
1600
ns
CCLK (output) Period, fast
TCCLK
67
200
ns
Description
Symbol
Min
Max
Units
Power-On Reset
TPOR
10
33
ms
Program Latency
TPI
30
200
s per
CLB column
CCLK (input) Delay (required)
TICCK
4
s
CCLK (input) Period (required)
TCCLK
100
ns
VALID
PROGRAM
INIT
Vcc
PI
T
POR
T
ICCK
T
CCLK
T
CCLK OUTPUT or INPUT
M0, M1, M2
DONE RESPONSE
<300 ns
>300 ns
RE-PROGRAM
X1532
(Required)
I/O
Product Obsolete or Under Obsolescence
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PDF描述 |
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参数描述 |
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