参数资料
| 型号： | XC5210-6TQ144C |
| 厂商： | Xilinx Inc |
| 文件页数： | 20/73页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 324 CLB'S 144-TQFP |
| 产品变化通告： | XC1700 PROMs,XC5200,HQ,SCD Parts Discontinuation 19/Jul/2010 |
| 标准包装： | 1 |
| 系列： | XC5200 |
| LAB/CLB数： | 324 |
| 逻辑元件/单元数： | 1296 |
| 输入/输出数： | 117 |
| 门数： | 16000 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-TQFP（20x20） |
| 其它名称： | 122-1152 |
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R
November 5, 1998 (Version 5.2)
7-109
XC5200 Series Field Programmable Gate Arrays
7
XC4000E/EX
XC5200/
UCLK_SYNC
XC4000E/EX
XC5200/
UCLK_NOSYNC
XC4000E/EX
XC5200/
CCLK_SYNC
XC4000E/EX
XC5200/
CCLK_NOSYNC
XC3000
XC2000
CCLK
GSR Active
UCLK Period
DONE IN
Di
Di+1
Di+2
Di
Di+1
Di+2
U2
U3
U4
U2
U3
U4
U2
U3
U4
C1
Synchronization
Uncertainty
Di
Di+1
Di
Di+1
DONE
I/O
GSR Active
DONE
I/O
GSR Active
DONE
C1
C2
C1
U2
C3
C4
C2
C3
C4
C2
C3
C4
I/O
GSR Active
DONE
I/O
DONE
Global Reset
I/O
DONE
Global Reset
I/O
F = Finished, no more
configuration clocks needed
Daisy-chain lead device
must have latest F
Heavy lines describe
default timing
CCLK Period
Length Count Match
F
X6700
C1, C2 or C3
Figure 25: Start-up Timing
Product Obsolete or Under Obsolescence
相关PDF资料 |
PDF描述 |
|---|---|
| AMC36DRYI | CONN EDGECARD 72POS .100 DIP SLD |
| XC3064L-8TQ144C | IC FPGA 3.3V C-TEMP 144-TQFP |
| XC3042L-8VQ100I | IC FPGA 3.3V I-TEMP 100-VQFP |
| AMM30DTKT-S288 | CONN EDGECARD 60POS .156 EXTEND |
| RMC65DRXI-S734 | CONN EDGECARD 130PS DIP .100 SLD |
相关代理商/技术参数 |
参数描述 |
|---|---|
| XC5210-6TQ144I | 制造商:Xilinx 功能描述: |
| XC5210-6TQ176C | 制造商:XILINX 制造商全称:XILINX 功能描述:Field Programmable Gate Arrays |
| XC5210-6VQ100C | 制造商:XILINX 制造商全称:XILINX 功能描述:Field Programmable Gate Arrays |
| XC5210-6VQ64C | 制造商:XILINX 制造商全称:XILINX 功能描述:Field Programmable Gate Arrays |
| XC5210PQ240-4C | 制造商:Xilinx 功能描述: |
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