参数资料
| 型号： | XC5VSX50T-2FFG1136I |
| 厂商： | Xilinx Inc |
| 文件页数： | 17/91页 |
| 文件大小： | 0K |
| 描述： | IC FPGA VIRTEX-5 50K 1136FBGA |
| 产品变化通告： | Step Intro and Pkg Change 11/March/2008 |
| 标准包装： | 1 |
| 系列： | Virtex®-5 SXT |
| LAB/CLB数： | 4080 |
| 逻辑元件/单元数： | 52224 |
| RAM 位总计： | 4866048 |
| 输入/输出数： | 480 |
| 电源电压： | 0.95 V ~ 1.05 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 1136-BBGA，FCBGA |
| 供应商设备封装： | 1136-FCBGA |
| 配用： | 568-5088-ND - BOARD DEMO DAC1408D750 122-1796-ND - EVALUATION PLATFORM VIRTEX-5 |
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Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
24
TJ3.75
Total Jitter(2)
3.75 Gb/s
0.34
UI
DJ3.75
Deterministic Jitter(2)
0.16
UI
TJ3.2
Total Jitter(2)
3.2 Gb/s
0.20
UI
DJ3.2
Deterministic Jitter(2)
0.10
UI
TJ3.2L
Total Jitter(2)
3.2 Gb/s(3)
0.36
UI
DJ3.2L
Deterministic Jitter(2)
0.16
UI
TJ2.5
Total Jitter(2)
2.5 Gb/s
0.20
UI
DJ2.5
Deterministic Jitter(2)
0.08
UI
TJ1.25
Total Jitter(2)
1.25 Gb/s
0.15
UI
DJ1.25
Deterministic Jitter(2)
0.06
UI
TJ750
Total Jitter(2)(4)
750 Mb/s
0.10
UI
DJ750
Deterministic Jitter(2)(4)
0.03
UI
TJ150
Total Jitter(2)(4)
150 Mb/s
0.02
UI
DJ150
Deterministic Jitter(2)(4)
0.01
UI
Notes:
1.
Using same REFCLK input with TXENPMAPHASEALIGN enabled for up to four consecutive GTX_DUAL sites.
2.
Using PLL_DIVSEL_FB = 2, INTDATAWIDTH = 1. These values are NOT intended for protocol specific compliance determinations.
3.
PLL frequency at 1.6 GHz and OUTDIV = 1.
4.
GREFCLK can be used for serial data rates up to 1.0 Gb/s, but performance is not guaranteed.
Table 47: GTX_DUAL Tile Receiver Switching Characteristics
Symbol
Description
Min
Typ
Max
Units
FGTXRX
Serial data rate
RX oversampler not enabled
0.75
FGTXMAX
Gb/s
RX oversampler enabled
0.15
0.75
Gb/s
TRXELECIDLE
TIme for RXELECIDLE to
respond to loss or
restoration of data
OOBDETECT_THRESHOLD = 110
75
ns
RXOOBVDPP
OOB detect threshold
peak-to-peak
OOBDETECT_THRESHOLD = 110
55
135
mV
RXSST
Receiver spread-spectrum
tracking(1)
Modulated @ 33 KHz
–5000
0
ppm
RXRL
Run length (CID)
Internal AC capacitor bypassed
512
UI
RXPPMTOL
Data/REFCLK PPM offset
tolerance(2)
CDR 2nd-order loop disabled
–200
200
ppm
CDR 2nd-order loop enabled
–2000
2000
ppm
SJ Jitter Tolerance(3)
JT_SJ6.5
Sinusoidal Jitter(4)
6.5 Gb/s
0.44
UI
JT_SJ5.0
Sinusoidal Jitter(4)
5.0 Gb/s
0.44
UI
JT_SJ4.25
Sinusoidal Jitter(4)
4.25 Gb/s
0.44
UI
JT_SJ3.75
Sinusoidal Jitter(4)
3.75 Gb/s
0.44
UI
JT_SJ3.2
Sinusoidal Jitter(4)
3.2 Gb/s
0.45
UI
JT_SJ3.2L
Sinusoidal Jitter(4)
3.2 Gb/s(5)
0.45
UI
JT_SJ2.5
Sinusoidal Jitter(4)
2.5 Gb/s
0.50
UI
JT_SJ1.25
Sinusoidal Jitter(4)
1.25 Gb/s
0.50
UI
Table 46: GTX_DUAL Tile Transmitter Switching Characteristics (Cont’d)
Symbol
Description
Condition
Min
Typ
Max
Units
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| XC5VSX50T-2FF1136I | IC FPGA VIRTEX-5 50K 1136FBGA |
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参数描述 |
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| XC5VSX50T-2FFG665I | 功能描述:IC FPGA VIRTEX-5 50K 665FCBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:Virtex®-5 SXT 产品变化通告:Step Intro and Pkg Change 11/March/2008 标准包装:1 系列:Virtex®-5 SXT LAB/CLB数:4080 逻辑元件/单元数:52224 RAM 位总计:4866048 输入/输出数:480 门数:- 电源电压:0.95 V ~ 1.05 V 安装类型:表面贴装 工作温度:-40°C ~ 100°C 封装/外壳:1136-BBGA，FCBGA 供应商设备封装:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5 |
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