参数资料
| 型号： | XCS20XL-5VQ100C |
| 厂商： | Xilinx Inc |
| 文件页数： | 36/83页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 3.3V C-TEMP HP 100VQFP |
| 产品变化通告： | Product Discontinuation 26/Oct/2011 |
| 标准包装： | 90 |
| 系列： | Spartan®-XL |
| LAB/CLB数： | 400 |
| 逻辑元件/单元数： | 950 |
| RAM 位总计： | 12800 |
| 输入/输出数： | 77 |
| 门数： | 20000 |
| 电源电压： | 3 V ~ 3.6 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-VQFP（14x14） |
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Spartan and Spartan-XL FPGA Families Data Sheet
DS060 (v2.0) March 1, 2013
41
Product Specification
R
Product Obsolete/Under Obsolescence
Configuration Switching Characteristics
Master Mode
Slave Mode
DS060_33_080400
TPOR
VCC
PROGRAM
Mode Pins
(Required)
CCLK Output or Input
DONE Response
RE-PROGRAM
I/O
INIT
TPI
TCCLK
TICCK
>300 ns
<300 ns
Symbol
Description
Min
Max
Units
TPOR
Power-on reset
40
130
ms
TPI
Program Latency
30
200
μs per CLB column
TICCK
CCLK (output) delay
40
250
μs
TCCLK
CCLK (output) period, slow
640
2000
ns
TCCLK
CCLK (output) period, fast
100
250
ns
Symbol
Description
Min
Max
Units
TPOR
Power-on reset
10
33
ms
TPI
Program latency
30
200
μs per CLB column
TICCK
CCLK (input) delay (required)
4
-
μs
TCCLK
CCLK (input) period (required)
80
-
ns
相关PDF资料 |
PDF描述 |
|---|---|
| FMC18DREN-S93 | CONN EDGECARD 36POS .100 EYELET |
| 65801-055LF | CLINCHER RECEPTACLE ASSY GOLD |
| XCS20XL-5CS144C | IC FPGA 3.3V C-TEMP HP 144CSBGA |
| FMC18DREH-S93 | CONN EDGECARD 36POS .100 EYELET |
| 65801-054LF | CLINCHER RECEPTACLE ASSY GOLD |
相关代理商/技术参数 |
参数描述 |
|---|---|
| XCS20XL-5VQ100I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan and Spartan-XL FPGA |
| XCS20XL-5VQ144C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan and Spartan-XL Families Field Programmable Gate Arrays |
| XCS20XL-5VQ144I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan and Spartan-XL Families Field Programmable Gate Arrays |
| XCS20XL-5VQ208C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan and Spartan-XL Families Field Programmable Gate Arrays |
| XCS20XL-5VQ208I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan and Spartan-XL Families Field Programmable Gate Arrays |
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