参数资料
| 型号： | XCV50E-7PQ240I |
| 厂商： | Xilinx Inc |
| 文件页数： | 224/233页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 1.8V I-TEMP 240-PQFP |
| 产品变化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 标准包装： | 24 |
| 系列： | Virtex®-E |
| LAB/CLB数： | 384 |
| 逻辑元件/单元数： | 1728 |
| RAM 位总计： | 65536 |
| 输入/输出数： | 158 |
| 门数： | 71693 |
| 电源电压： | 1.71 V ~ 1.89 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 240-BFQFP |
| 供应商设备封装： | 240-PQFP（32x32） |
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
Module 4 of 4
DS022-4 (v3.0) March 21, 2014
4
Production Product Specification
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
CS144 Chip-Scale Package
XCV50E, XCV100E, XCV200E, XCV300E and XCV400E
devices in CS144 Chip-scale packages have footprint com-
patibility. In the CS144 package, bank pairs that share a
side are internally interconnected, permitting four choices
Pins labeled I0_VREF can be used as either in all parts
unless device-dependent, as indicated in the footnotes. If
the pin is not used as VREF, it can be used as general I/O.
Pair information.
Table 3: I/O Bank Pairs and Shared Vcco Pins
Paired Banks
Shared VCCO Pins
Banks 0 & 1
A2, A13, D7
Banks 2 & 3
B12, G11, M13
Banks 4 & 5
N1, N7, N13
Banks 6 & 7
B2, G2, M2
Table 4: CS144 — XCV50E, XCV100E, XCV200E
Bank
Pin Description
Pin #
0GCK3
A6
0IO
B3
0
IO_VREF_L0N_YY
B42
0
IO_L0P_YY
A4
0
IO_L1N_YY
B5
0
IO_L1P_YY
A5
0
IO_LVDS_DLL_L2N
C6
0
IO_VREF
A31
0IO_VREF
C4
0IO_VREF
D6
1GCK2
A7
1IO
A8
1
IO_LVDS_DLL_L2P
B7
1
IO_L3N_YY
C8
1
IO_L3P_YY
D8
1
IO_L4N_YY
C9
1
IO_VREF_L4P_YY
D92
1
IO_WRITE_L5N_YY
C10
1
IO_CS_L5P_YY
D10
1
IO_VREF
A10
1
IO_VREF
B8
1
IO_VREF
B101
2IO
D12
2IO
F12
2
IO_DOUT_BUSY_L6P_YY
C11
2
IO_DIN_D0_L6N_YY
C12
2
IO_D1_L7N
E10
2
IO_VREF_L7P
D132
2IO_L8N_YY
E13
2
IO_D2_L8P_YY
E12
2
IO_D3_L9N
F11
2
IO_VREF_L9P
F10
2
IO_L10P
F13
2
IO_VREF
C131
2
IO_VREF
D11
3IO
H13
3IO
K13
3
IO_L10N
G13
3
IO_VREF_L11N
H11
3
IO_D4_L11P
H12
3
IO_D5_L12N_YY
J13
3
IO_L12P_YY
H10
3
IO_VREF_L13N
J102
3
IO_D6_L13P
J11
3
IO_INIT_L14N_YY
L13
3
IO_D7_L14P_YY
K10
3
IO_VREF
K111
3
IO_VREF
K12
4GCK0
K7
4IO
M8
4IO
M10
Table 4: CS144 — XCV50E, XCV100E, XCV200E
Bank
Pin Description
Pin #
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相关代理商/技术参数 |
参数描述 |
|---|---|
| XCV50E-7PQG240C | 制造商:Xilinx 功能描述:IC SYSTEM GATE 制造商:Xilinx 功能描述:FPGA VIRTEX-E 20.736K GATES 1728 CELLS 400MHZ 0.18UM 1.8V 24 - Trays |
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| XCV50E-8BG240I | 制造商:XILINX 制造商全称:XILINX 功能描述:Virtex⑩-E 1.8 V Field Programmable Gate Arrays |
| XCV50E-8CS144C | 功能描述:IC FPGA 1.8V C-TEMP 144-CSBGA RoHS:否 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:Virtex®-E 标准包装:40 系列:Spartan® 6 LX LAB/CLB数:3411 逻辑元件/单元数:43661 RAM 位总计:2138112 输入/输出数:358 门数:- 电源电压:1.14 V ~ 1.26 V 安装类型:表面贴装 工作温度:-40°C ~ 100°C 封装/外壳:676-BGA 供应商设备封装:676-FBGA（27x27） |
| XCV50E-8CS144I | 制造商:XILINX 制造商全称:XILINX 功能描述:Virtex-E 1.8 V Field Programmable Gate Arrays |
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