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参数资料
| 型号： | YMF724 |
| 厂商： | Yamaha Corporation |
| 英文描述： | high performance audio controller for the PCI Bus |
| 中文描述： | 高性能音频控制器的PCI总线 |
| 文件页数： | 41/50页 |
| 文件大小： | 268K |
| 代理商： | YMF724 |
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YMF724F
January 14, 1999
-46-
4-4. AC’97 / AC3F2 Master Clock
(Fig.5)
Item
Symbol
Min.
Typ.
Max.
Unit
CMCLK Cycle Time
tCMCYC
-
40.69
-
ns
CMCLK High Time
tCMHIGH
8-
-
ns
CMCLK Low Time
tCMLOW
8-
ns
CMCLK Rising Time
tCMR
-4.6
-
ns
CMCLK Falling Time
tCMF
-2.1
-
ns
Note : Top = 0-70°C, PVDD=5.0
±0.25 V, VDD5=5.0±0.25 V, VDD3=3.3±0.3 V, LVDD=3.3±0.3 V, C
L=50 pF
t
CMCLK
CMCYC
t
CMF
t
CMR
t
CMHIGH
0.4 V
2.5 V
3.5 V
t
CMLOW
Fig.5: Master Clock timing for AC’97 and AC3F2
4-5. AC-link
(Fig.6)
Item
Symbol
Condition
Min.
Typ.
Max.
Unit
CBCLK Cycle Time
tCBICYC
-
81.4
-
ns
CBCLK High Time
tCBIHIGH
35
40.7
45
ns
CBCLK Low Time
tCBILOW
35
40.7
45
ns
CSYNC Cycle Time
tCSYCYC
-
20.8
-
ns
CSYNC High Time
tCSYHIGH
-1.3
-
ns
CSYNC Low Time
tCSYLOW
-
19.5
-
ns
CBCLK to Signal Valid Delay
tCVAL
*12
-
20
ns
Output Hold Time for CBCLK
tCOH
*12
0
-
ns
Input Setup Time to CBCLK
tCISU
*13
15
-
ns
Input Hold Time for CBCLK
tCIH
*13
5
-
ns
Warm Reset Width
-
1.3
-
s
Note) Top = 0-70°C, PVDD=5.0
±0.25 V, VDD5=5.0±0.25 V, VDD3=3.3±0.3 V, LVDD=3.3±0.3 V, C
L=50 pF
*12: This characteristic is applicable to CSYNC and CSDO signal.
*13: This characteristic is applicable to CSDI signal.
相关PDF资料 |
PDF描述 |
|---|---|
| YMF724F | high performance audio controller for the PCI Bus |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| YMF724F | 制造商:YAMAHA 制造商全称:YAMAHA CORPORATION 功能描述:high performance audio controller for the PCI Bus |
| YMF724F-V | 制造商:YAMAHA 制造商全称:YAMAHA CORPORATION 功能描述:high performance audio controller for the PCI Bus |
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