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参数资料
| 型号： | ZL2004ALNFT |
| 厂商： | Intersil |
| 文件页数： | 12/42页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK SYNC ADJ 32QFN |
| 标准包装： | 100 |
| PWM 型： | 电压模式 |
| 输出数： | 1 |
| 频率 - 最大： | * |
| 占空比： | 95% |
| 电源电压： | 4.5 V ~ 14 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | * |
| 包装： | * |
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ZL2004
5. Power Conversion Functional Description
5.1 Internal Bias Regulators and Input Supply
Connections
The ZL2004 employs two internal low dropout (LDO)
regulators to supply bias voltages for internal circuitry,
allowing it to operate from a single input supply. The
internal bias regulators are as follows:
VR: The VR LDO provides a regulated 5 V bias
supply for the MOSFET pre-driver circuits. It is
powered from the VDD pin. A 4.7 μF filter
capacitor is required at the VR pin.
V25: The V25 LDO provides a regulated 2.5 V bias
supply for the main controller circuitry. It is
5.2 Output Voltage Selection
Standard Mode
The output voltage may be set to any voltage between
0.6 V and 3.6 V provided that the input voltage is
higher than the desired output voltage by an amount
sufficient to prevent the device from exceeding its
maximum duty cycle specification. Using the pin-strap
method, V OUT can be set to any of nine standard
Table 6. Pin-strap Output Voltage Settings
V0
powered from an internal 5 V node. A 10 μF
LOW
OPEN
HIGH
filter capacitor is required at the V25 pin.
LOW
0.6 V
0.8 V
1.0 V
When the input supply (VDD) is higher than 5.5 V, the
VR pin should not be connected to any other pins. It
V1
OPEN
HIGH
1.2 V
2.5 V
1.5 V
3.3 V
1.8 V
3.6 V
should only have a filter capacitor attached as shown in
the VR bias regulator, the VDD pin must be connected
to the VR pin for designs operating from a supply
below 5.5 V. Figure 7 illustrates the required
connections for both cases.
The resistor setting method can be used to set the
Resistors R0 and R1 are selected to produce a specific
voltage between 0.6 V and 3.6 V in 10 mV steps.
Resistor R1 provides a coarse setting and resistor R0
provides a fine adjustment, thus eliminating the
VDD
ZL2004
VR
4.5V ≤ V IN ≤ 5.5V
V IN
V IN
VDD
ZL2004
VR
5.5V <V IN ≤ 14V
additional errors associated with using two 1%
resistors (this typically adds 1.4% error).
To set V OUT using resistors, follow the steps below to
calculate an index value and then use Table 7 to select
the resistor that corresponds to the calculated index
value as follows:
1. Calculate Index1:
Figure 7. Input Supply Connections
Note : the internal bias regulators are not designed to be
outputs for powering other circuitry. Do not attach
external loads to any of these pins. The multi-mode
pins may be connected to the V25 pin for logic HIGH
settings.
12
Index1 = 4 x V OUT (V OUT in 10 mV steps)
2. Round the result down to the nearest whole
number.
3. Select the value of R1 from Table 7 using the
Index1 rounded value from step 2.
4. Calculate Index0:
Index0 = 100 x V OUT – (25 x Index1)
5. Select the value of R0 from Table 7 using the
Index0 value from step 4.
FN6846.3
February 15, 2011
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