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参数资料
| 型号： | ZL2105ALNFT1 |
| 厂商： | Intersil |
| 文件页数： | 8/36页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC ADJ 3A 36QFN |
| 标准包装： | 1,000 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 0.6 V ~ 5.5 V |
| 输入电压： | 4.5 V ~ 14 V |
| PWM 型： | 电压模式 |
| 频率 - 开关： | 200kHz ~ 2MHz |
| 电流 - 输出： | 3A |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 供应商设备封装： | 36-QFN（6x6） |
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ZL2105
3. Typical Application Circuit
The following application circuit represents a typical implementation of the ZL2105.
ENABLE
PGOOD
C 25
10μF
C DD
2.2μF
C RA
4.7μF
F.B.*
C IN
V IN
12V
100μF
R VR
91 ?
1
2
3
DGND
SYNC
SA
VR 27
BST 26
VDDP 25
C B
47nF
C R
4.7μF
I C/SMBus
2
4
5
6
7
UVLO
ILIM
SCL
SDA
ZL2105
VDDP 24
SW 23
SW 22
PGND 21
L OUT
4.7μH
V OUT
3.3V
8
9
SALRT
XTEMP
PGND 20
CP2 19
C OUT
150μF
C DR
100nF
* Ferrite bead is optional for input noise suppression
Figure 3. 12 V to 3.3 V / 3 A Application Circuit
(10.8 V UVLO, 10 ms SS delay, 50 ms SS ramp, 12 V used for low-side FET driver)
8
FN6851.2
March 30, 2011
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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