参数资料
| 型号： | 24VL014/P |
| 厂商： | Microchip Technology |
| 文件页数： | 3/30页 |
| 文件大小： | 0K |
| 描述： | IC EEPROM 1KBIT 400KHZ 8DIP |
| 标准包装： | 60 |
| 格式 - 存储器： | EEPROMs - 串行 |
| 存储器类型： | EEPROM |
| 存储容量： | 1K (128 x 8) |
| 速度： | 100kHz，400kHz |
| 接口： | I²C，2 线串口 |
| 电源电压： | 1.5 V ~ 3.6 V |
| 工作温度： | -20°C ~ 85°C |
| 封装/外壳： | 8-DIP（0.300"，7.62mm） |
| 供应商设备封装： | 8-PDIP |
| 包装： | 管件 |
| 产品目录页面： | 1443 (CN2011-ZH PDF) |
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24VL014
TABLE 1-2:
AC CHARACTERISTICS
AC CHARACTERISTICS
Electrical Characteristics:
V CC = +1.5V to 3.6V T A = -20°C to +85°C
Param.
No.
1
2
Symbol
F CLK
T HIGH
Characteristic
Clock frequency
Clock high time
Min.
—
—
4000
Max.
100
400
—
Units
kHz
ns
Conditions
1.5V ≤ V CC < 1.8V
1.8V ≤ V CC ≤ 3.6V
1.5V ≤ V CC < 1.8V
600
—
1.8V ≤ V CC ≤ 3.6V
3
T LOW
Clock low time
4700
—
ns
1.5V ≤ V CC < 1.8V
1300
—
1.8V ≤ V CC ≤ 3.6V
4
5
T R
T F
SDA and SCL rise time
(Note 1)
SDA and SCL fall time
—
—
—
1000
300
1000
ns
ns
1.5V ≤ V CC < 1.8V
1.8V ≤ V CC ≤ 3.6V
1.5V ≤ V CC < 1.8V
(Note 1)
—
300
1.8V ≤ V CC ≤ 3.6V
6
T HD : STA
Start condition hold time
4000
—
ns
1.5V ≤ V CC < 1.8V
600
—
1.8V ≤ V CC ≤ 3.6V
7
8
9
10
T SU : STA
T HD : DAT
T SU : DAT
T SU : STO
Start condition setup time
Data input hold time
Data input setup time
Stop condition setup time
4700
600
0
250
100
4000
—
—
—
—
—
—
ns
ns
ns
ns
1.5V ≤ V CC < 1.8V
1.8V ≤ V CC ≤ 3.6V
(Note 2)
1.5V ≤ V CC < 1.8V
1.8V ≤ V CC ≤ 3.6V
1.5V ≤ V CC < 1.8V
600
—
1.8V ≤ V CC ≤ 3.6V
11
T SU : WP
WP setup time
4000
—
ns
1.5V ≤ V CC < 1.8V
600
—
1.8V ≤ V CC ≤ 3.6V
12
13
T HD : WP
T AA
WP hold time
Output valid from clock
4700
600
—
—
—
3500
ns
ns
1.5V ≤ V CC < 1.8V
1.8V ≤ V CC ≤ 3.6V
1.5V ≤ V CC < 1.8V
(Note 2)
—
900
1.8V ≤ V CC ≤ 3.6V
14
T BUF
Bus free time: Time the bus must
4700
—
ns
1.5V ≤ V CC < 1.8V
be free before a new transmis-
1300
—
1.8V ≤ V CC ≤ 3.6V
sion can start
15
T SP
Input filter spike suppression
—
50
ns
(Note 1 and Note 3)
(SDA and SCL pins)
16
T WC
Write cycle time (byte or page)
—
5
ms
—
17
—
Endurance
1M
—
cycles 25°C, V CC = 3.6V, per page
(Note 4)
Note 1: Not 100% tested. C B = total capacitance of one bus line in pF.
2: As a transmitter, the device must provide an internal minimum delay time to bridge the undefined region
(minimum 300 ns) of the falling edge of SCL to avoid unintended generation of Start or Stop conditions.
3: The combined T SP and V HYS specifications are due to new Schmitt Trigger inputs, which provide improved
noise spike suppression. This eliminates the need for a T I specification for standard operation.
4: This parameter is not tested but ensured by characterization. For endurance estimates in a specific appli-
cation, please consult the Total Endurance? Model which can be obtained from Microchip’s web site at
www.microchip.com.
? 2009 Microchip Technology Inc.
DS22129A-page 3
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