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参数资料
| 型号： | 73S8023C-IMR/F |
| 厂商： | MAXIM INTEGRATED PRODUCTS INC |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, QCC32 |
| 封装： | 5 X 5 MM, LEAD FREE, QFN-32 |
| 文件页数： | 15/27页 |
| 文件大小： | 389K |
| 代理商： | 73S8023C-IMR/F |
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73S8023C Data Sheet
DS_8023C_019
22
Rev. 1.5
Symbol
Parameter
Condition
Min
Typ
Max
Unit
Reset and Clock for card interface, RST, CLK
V
Output level, high
OH
IOH
0.9 V
= -200
A
CC
V
CC
V
Output level, low
OL
IOL
0
= 200
A
0.2
V
Output voltage when outside
of a session
INACT
IOL = 0
0.1
V
IOL = 1 mA
0.3
V
I
Output current limit, RST
RST_LIM
30
mA
I
Output current limit, CLK
CLK_LIM
70
mA
tR, t
Output rise time, fall time
F
CL = 35 pF for
CLK, 10% to 90%
8
ns
CL = 200 pF for
RST, 10% to 90%
100
ns
Td
Delay time STROBE to CLK,
RSTIN to RST
CLKSEL = 1, Cap.
load on CLK and
RST is minimal,
else rise, fall times
are a factor
20
ns
δ
Duty cycle for CLK
CL = 35 pF,
48% <
δ
IN
45
< 52%
55
%
12.5 Digital Signals
Symbol
Parameter
Condition
Min
Typ
Max
Unit
Digital I/O Except for OSC I/O
VIL
Input Low Voltage
-0.3
0.8
V
VIH
Input High Voltage
1.8
VDD + 0.3
V
VOL
Output Low Voltage
IOL = 2 mA
0.45
V
VOH
Output High Voltage
IOH = -1 mA
VDD - 0.45
V
ROUT
Pull-up resistor,
OFF
20
k
tSL
Time from CS going high to
interface active
50
ns
tDZ
Time from CS going low to
interface inactive, Hi-Z
50
ns
tIS
Set-up time, control signals
to CS rising edge
50
ns
tSI
Hold time, control signals
from CS rising edge
50
ns
tID
Set-up time, control signals
to CS fall
50
ns
tDI
Hold time, control signals
from CS fall
50
ns
|IIL1|
Input Leakage Current
GND < VIN < VDD
-5
5
μA
相关PDF资料 |
PDF描述 |
|---|---|
| 74HC4046AD/T3 | PLL FREQUENCY SYNTHESIZER, PDSO16 |
| 74HC4067NB | 16-CHANNEL, SGL ENDED MULTIPLEXER, PDIP24 |
| 74HCT4067NB | 16-CHANNEL, SGL ENDED MULTIPLEXER, PDIP24 |
| 74HC5555D/T3 | SPECIALTY ANALOG CIRCUIT, PDSO16 |
| 74HCT4016DB-T | QUAD 1-CHANNEL, SGL POLE SGL THROW SWITCH, PDSO14 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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