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参数资料
| 型号： | 74HC193DB,112 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 13/30页 |
| 文件大小： | 0K |
| 描述： | IC SYNC 4BIT BINARY UP/DN 16SSOP |
| 产品培训模块： | Logic Packages |
| 标准包装： | 78 |
| 系列： | 74HC |
| 逻辑类型： | 二进制计数器 |
| 方向： | 上，下 |
| 元件数： | 1 |
| 每个元件的位元数： | 4 |
| 复位： | 异步 |
| 计时： | 同步 |
| 计数速率： | 49MHz |
| 触发器类型： | 正边沿 |
| 电源电压： | 2 V ~ 6 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SSOP（0.209"，5.30mm 宽） |
| 供应商设备封装： | 16-SSOP |
| 包装： | 管件 |
| 其它名称： | 568-2634-5 935188610112 |
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74HC_HCT193
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Product data sheet
Rev. 4 — 24 June 2013
20 of 30
NXP Semiconductors
74HC193; 74HCT193
Presettable synchronous 4-bit binary up/down counter
The shaded areas indicate when the input is permitted to change for predictable output performance.
Measurement points are given in Table 10.
Logic levels VOL and VOH are typical output voltage levels that occur with the output load.
Fig 13. The data input (Dn) to parallel load input (PL) set-up and hold times
001aag417
Dn input
Qn output
VOL
VOH
GND
VI
GND
VI
PL input
VM
tsu
th
VM
tsu
th
Measurement points are given in Table 10.
tPLH and tPHL are the same as tpd.
Logic levels VOL and VOH are typical output voltage levels that occur with the output load.
Fig 14. The data input (Dn), parallel load input (PL) and the master reset input (MR) to the terminal count outputs
(TCU,TCD) propagation delays
001aag418
PL, MR, Dn
input
TCU, TCD
output
tPLH
tPHL
VM
VOL
VOH
GND
VI
Measurement points are given in Table 10.
Fig 15. The CPU to CPD or CPD to CPU hold times
001aag419
CPD or CPU
input
CPU or CPD
input
VI
GND
VI
GND
VM
th
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