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参数资料
| 型号： | 74HC193DB,112 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 7/30页 |
| 文件大小： | 0K |
| 描述： | IC SYNC 4BIT BINARY UP/DN 16SSOP |
| 产品培训模块： | Logic Packages |
| 标准包装： | 78 |
| 系列： | 74HC |
| 逻辑类型： | 二进制计数器 |
| 方向： | 上，下 |
| 元件数： | 1 |
| 每个元件的位元数： | 4 |
| 复位： | 异步 |
| 计时： | 同步 |
| 计数速率： | 49MHz |
| 触发器类型： | 正边沿 |
| 电源电压： | 2 V ~ 6 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SSOP（0.209"，5.30mm 宽） |
| 供应商设备封装： | 16-SSOP |
| 包装： | 管件 |
| 其它名称： | 568-2634-5 935188610112 |
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74HC_HCT193
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NXP B.V. 2013. All rights reserved.
Product data sheet
Rev. 4 — 24 June 2013
15 of 30
NXP Semiconductors
74HC193; 74HCT193
Presettable synchronous 4-bit binary up/down counter
[1]
tpd is the same as tPHL and tPLH.
[2]
CPD is used to determine the dynamic power dissipation (PD in W):
PD =CPD VCC2 fi N+ (CL VCC2 fo) where:
fi = input frequency in MHz;
fo = output frequency in MHz;
CL = output load capacitance in pF;
VCC = supply voltage in V;
N = number of inputs switching;
(C
L VCC
2
f
o) = sum of outputs.
tsu
set-up time
Dn to PL; see
Figure 13; note:
CPU = CPD =
HIGH
VCC = 2.0 V
80
22
-
100
-
120
-
ns
VCC =4.5 V
16
8
-
20
-
24
-
ns
VCC =6.0 V
14
6
-
17
-
20
-
ns
th
hold time
Dn to PL; see
VCC =2.0 V
0
14
-
0
-
0
-
ns
VCC =4.5 V
0
5-
0
-
0
-
ns
VCC =6.0 V
0
4-
0
-
ns
CPU to CPD,
CPD to CPU; see
VCC = 2.0 V
80
22
-
100
-
120
-
ns
VCC =4.5 V
16
8
-
20
-
24
-
ns
VCC =6.0 V
8
6
-
17
-
20
-
ns
fmax
maximum
frequency
CPU, CPD; see
VCC = 2.0 V
4.0
13.5
-
3.2
-
2.6
-
MHz
VCC =4.5 V
20
41
-
16
-
13
-
MHz
VCC =6.0 V
24
49
-
19
-
15
-
MHz
CPD
power
dissipation
capacitance
VI = GND to VCC;
VCC =5V;
fi =1 MHz
-24-
-
pF
Table 8.
Dynamic characteristics type 74HC193 …continued
Symbol
Parameter
Conditions
25
C
40 C to +85 C 40 C to +125 C Unit
Min
Typ
Max
Min
Max
Min
Max
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