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参数资料
| 型号： | 74LV74PW,112 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 2/19页 |
| 文件大小： | 0K |
| 描述： | IC DUAL D FF POSEDG TRIG 14TSSOP |
| 产品培训模块： | Logic Packages |
| 标准包装： | 2,400 |
| 系列： | 74LV |
| 功能： | 设置（预设）和复位 |
| 类型： | D 型 |
| 输出类型： | 差分 |
| 元件数： | 2 |
| 每个元件的位元数： | 1 |
| 频率 - 时钟： | 56MHz |
| 触发器类型： | 正边沿 |
| 输出电流高，低： | 12mA，12mA |
| 电源电压： | 1 V ~ 5.5 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 14-TSSOP（0.173"，4.40mm 宽） |
| 包装： | 管件 |
74LV74
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NXP B.V. 2013. All rights reserved.
Product data sheet
Rev. 3 — 9 September 2013
10 of 19
NXP Semiconductors
74LV74
Dual D-type flip-flop with set and reset; positive-edge trigger
11. Waveforms
Measurement points are given in Table 8.
The shaded areas indicate when the input is permitted to change for predictable output performance.
Fig 6.
Clock pulse (nCP) to output (nQ, nQ) propagation delays, nCP pulse width and maximum frequency
aaa-008840
GND
VI
GND
VI
VOH
VOL
nCP input
nQ output
nD input
tsu
tPLH
tPHL
VM
tW
tPHL
VM
th
tsu
1/fmax
tPLH
th
Measurement points are given in Table 8.
Fig 7.
The set (nSD) and reset (nRD) input to output (nQ, nQ) propagation delays, the set and reset pulse widths
and the nRD to nCP recovery time
trec
VM
aaa-008842
tPHL
tPLH
tPHL
tPLH
tW
VM
VI
VOH
VOL
VOH
VM
GND
nCP input
nSD input
nRD input
nQ output
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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