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参数资料
| 型号： | A3PN030-Z1VQG100 |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 768 CLBS, 30000 GATES, PQFP100 |
| 封装： | 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, VQFP-100 |
| 文件页数： | 59/100页 |
| 文件大小： | 3284K |
| 代理商： | A3PN030-Z1VQG100 |
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ProASIC3 nano DC and Switching Characteristics
Ad vance v0.2
2-47
Global Resource Characteristics
A3PN250 Clock Tree Topology
Clock delays are device-specific. Figure 2-23 is an example of a global tree used for clock routing.
The global tree presented in Figure 2-23 is driven by a CCC located on the west side of the A3PN250
device. It is used to drive all D-flip-flops in the device.
Figure 2-23 Example of Global Tree Use in an A3PN250 Device for Clock Routing
Central
Global Rib
VersaTile
Rows
Global Spine
CCC
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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