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参数资料
| 型号： | AD5322BRM |
| 厂商： | ANALOG DEVICES INC |
| 元件分类： | DAC |
| 英文描述： | 12-bit, 210MSPS ADC with DDR LVDS/CMOS outputs 48-VQFN -40 to 85 |
| 中文描述： | SERIAL INPUT LOADING, 8 us SETTLING TIME, 12-BIT DAC, PDSO10 |
| 封装： | MO-187BA, MSOP-10 |
| 文件页数： | 8/16页 |
| 文件大小： | 207K |
| 代理商： | AD5322BRM |
REV. 0
AD5302/AD5312/AD5322
–8–
SINK/SOURCE CURRENT – mA
V
O
5
0
0
1
2
3
3
2
1
4
4
5
6
5V SOURCE
3V SOURCE
3V SINK
5V SINK
Figure 14. Source and Sink Current
Capability
V
DD
– Volts
1.0
0
2.7
3.2
5.2
3.7
4.2
4.7
0.4
0.2
0.8
0.6
BOTH DACS IN
THREE-STATE CONDITION
I
D
m
A
–40
8
C
+25
8
C
+105
8
C
Figure 17. Power-Down Current vs.
Supply Voltage
CH1 1V, CH2 1V, TIME BASE = 20
m
s/DIV
CH2
CH1
V
DD
V
OUT
A
T
A
= +25
8
C
Figure 20. Power-On Reset to 0 V
I
D
m
A
600
0
ZERO-SCALE
FULL-SCALE
200
100
500
400
300
V
DD
= +5V
T
A
= +25
8
C
Figure 15. Supply Current vs. Code
V
LOGIC
– Volts
700
100
0
0.5
4.5
1.5
2.5
3.5
400
300
600
500
I
D
m
A
1.0
2.0
3.0
4.0
5.0
200
T
A
= +25
8
C
V
DD
= +5V
V
DD
= +3V
Figure 18. Supply Current vs. Logic
Input Voltage
CH1 1V, CH3 5V, TIME BASE = 1
m
s/DIV
CH3
CH1
V
OUT
CLK
T
A
= +25
8
C
Figure 21. Exiting Power-Down to
Midscale
I
DD
–
m
A
F
0
100
150
400
200
250
350
300
V
DD
= +5V
V
DD
= +3V
Figure 13. I
DD
Histogram with V
DD
=
+3 V and V
DD
= +5 V
V
DD
– Volts
I
D
m
A
600
0
2.5
3.0
5.5
3.5
4.0
300
200
100
500
4.5
5.0
BOTH DACS IN GAIN-OF-TWO MODE
REFERENCE INPUTS BUFFERED
400
–40
8
C
+25
8
C
+105
8
C
Figure 16. Supply Current vs. Supply
Voltage
CH1 1V, CH2 5V, TIME BASE = 5
m
s/DIV
CH2
CH1
CLK
V
OUT
V
DD
= +5V
T
A
= +25
8
C
Figure 19. Half-Scale Settling (1/4 to
3/4 Scale Code Change)
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