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参数资料
| 型号： | AD9233-80EBZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 18/44页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD9233 |
| 标准包装： | 1 |
| ADC 的数量： | 1 |
| 位数： | 12 |
| 采样率（每秒）： | 80M |
| 数据接口： | 串行，SPI? |
| 输入范围： | 1 ~ 2 Vpp |
| 在以下条件下的电源（标准）： | 288mW @ 80kSPS |
| 工作温度： | -40°C ~ 85°C |
| 已用 IC / 零件： | AD9233 |
| 已供物品： | 板 |
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AD9233
Rev. A | Page 25 of 44
Table 15. Memory Map Register
Addr
(Hex)
Parameter
Name
Bit 7
(MSB)
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
(LSB)
Default
Value
(Hex)
Default
Notes/
Comments
Chip Configuration Registers
00
chip_port_config
0
LSB
First
0 = Off
(Default)
1 = On
Soft
Reset
0 = Off
(Default)
1 = On
1
Soft
Reset
0 = Off
(Default)
1 = On
LSB
First
0 = Off
(Default)
1 = On
0
0x18
The nibbles
should be
mirrored. See
01
chip_id
8-Bit Chip ID Bits 7:0
(AD9233 = 0x00), (Default)
Read-
Only
Default is
unique chip ID,
different for
each device.
02
chip_grade
Open
Child ID
0 =
125
MSPS,
1 =
105
MSPS
Open
Read-
Only
Child ID used
to differentiate
speed grades.
Device Index and Transfer Registers
FF
device_update
Open
SW Transfer
0x00
Synchronously
transfers data
from the
master
shift register to
the slave.
Global ADC Functions
08
modes
Open
PDWN
0—Full
1—
Standby
Open
Internal Power-Down Mode
000—Normal (Power-Up)
001—Full Power-Down
010—Standby
011—Normal (Power-Up)
Note: External PDWN pin
overrides this setting.
0x00
Determines
various generic
modes of chip
operation. See
Mode and
sections.
09
clock
Open
Duty Cycle
Stabilizer
0—
Disabled
1—Enabled
0x01
See Clock Duty
Cycle and
sections.
Flexible ADC Functions
10
offset
Digital Offset Adjust <5:0>
011111
011110
011101
…
000010
000001
000000
111111
111110
111101
...
100001
100000
Offset in LSBs
+7 3/4
+7 1/2
+7 1/4
+1/2
+1/4
0
1/4
1/2
3/4
7 3/4
8
0x00
Adjustable for
offset inherent
in the
converter.
See SPI-
section.
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PDF描述 |
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参数描述 |
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