参数资料
型号: AD9514BCPZ
厂商: Analog Devices Inc
文件页数: 2/28页
文件大小: 0K
描述: IC CLOCK DIST 3OUT PLL 32LFCSP
标准包装: 1
类型: 扇出缓冲器(分配),除法器
PLL:
输入: 时钟
输出: CMOS,LVDS,LVPECL
电路数: 1
比率 - 输入:输出: 1:3
差分 - 输入:输出: 是/是
频率 - 最大: 1.6GHz
除法器/乘法器: 是/无
电源电压: 3.135 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 32-VFQFN 裸露焊盘,CSP
供应商设备封装: 32-LFCSP-VQ(5x5)
包装: 托盘
产品目录页面: 776 (CN2011-ZH PDF)
配用: AD9514/PCBZ-ND - BOARD EVAL CLOCK 3CH AD9514
AD9514
Rev. 0 | Page 10 of 28
SYNCB, VREF, AND SETUP PINS
Table 6.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
SYNCB
Logic High
2.7
V
Logic Low
0.40
V
Capacitance
2
pF
VREF
Output Voltage
0.62 VS
0.76 VS
V
Minimum maximum from 0 mA to 1 mA load
S0 TO S10
Levels
0
0.1 VS
V
1/3
0.2 VS
0.45 VS
V
2/3
0.55 VS
0.8 VS
V
1
0.9 VS
V
POWER
Table 7.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
POWER-ON SYNCHRONIZATION1
35
ms
VS Transit Time from 2.2 V to 3.1 V
POWER DISSIPATION
295
405
550
mW
All outputs on. 2 LVPECL (divide = 2), 1 LVDS (divide = 2). No clock.
Does not include power dissipated in external resistors.
380
490
635
mW
All outputs on. 2 LVPECL (divide = 2), 1 CMOS (divide = 2);
at 62.5 MHz out (5 pF load).
410
525
680
mW
All outputs on. 2 LVPECL, 1 CMOS (divide = 2); At 125 MHz out (5 pF load).
POWER DELTA
Divider (Divide = 2 to Divide = 1)
15
30
45
mW
For each divider. No clock.
LVPECL Output
65
90
125
mW
For each output. No clock.
LVDS Output
20
50
85
mW
No clock.
CMOS Output (Static)
30
40
50
mW
No clock.
CMOS Output (@ 62.5 MHz)
80
110
140
mW
Single-ended. At 62.5 MHz out with 5 pF load.
CMOS Output (@ 125 MHz)
110
150
190
mW
Single-ended. At 125 MHz out with 5 pF load.
Delay Block
30
45
65
mW
Off to 1.5 ns fs, delay word = 60; output clocking at 62.5 MHz.
1 This is the rise time of the VS supply that is required to ensure that a synchronization of the outputs occurs on power-up. The critical factor is the time it takes the VS to
transition the range from 2.2 V to 3 .1 V. If the rise time is too slow, the outputs will not be synchronized.
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