参数资料
| 型号： | AD9516-5BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 8/76页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN W/PLL 64-LFCSP |
| 标准包装： | 1 |
| 类型： | 时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:14 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.4GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
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AD9516-5
Rev. A | Page 16 of 76
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
PIN 1
INDICATOR
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
CS
NC
SD
O
SDI
O
RE
S
E
T
PD
OU
T4
OU
T4
VS_
L
VPECL
OU
T5
OU
T5
VS
64
63
62
61
60
59
58
57
56
55
54
53
52
51
50
49
RE
F
IN
(
R
E
F
1)
RE
F
IN
(
R
E
F
2)
CP
RS
E
T
VS
GN
D
R
SET
VS
OU
T
0
OU
T
0
VS_
L
VPEC
L
OU
T
1
OU
T
1
VS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
VS
REFMON
LD
VCP
CP
STATUS
REF_SEL
SYNC
NC
VS
CLK
NC
SCLK
OUT6 (OUT6A)
OUT6 (OUT6B)
OUT7 (OUT7A)
OUT7 (OUT7B)
GND
OUT2
VS_LVPECL
OUT3
VS
GND
OUT9 (OUT9B)
OUT9 (OUT9A)
OUT8 (OUT8B)
OUT8 (OUT8A)
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
AD9516-5
TOP VIEW
(Not to Scale)
LVPECL LVPECL
LV
P
E
C
L
V
PEC
L
LV
D
S
/C
M
O
S
w
/FI
NE
D
E
L
A
Y
ADJ
US
T
LVDS/
C
M
O
S
w
/F
INE
DE
LAY
A
DJ
US
T
NOTES
1. NC = NO CONNECT. DO NOT CONNECT TO THIS PIN.
2. EXPOSED DIE PAD MUST BE CONNECTED TO GND.
0797
2-
0
03
Figure 6. Pin Configuration
Table 17. Pin Function Descriptions
Pin No.
Input/
Output
Pin Type
Mnemonic
Description
1, 11, 12, 30,
31, 32, 38,
49, 50, 51,
57, 60, 61
I
Power
VS
3.3 V Power Pins.
2
O
3.3 V CMOS
REFMON
Reference Monitor (Output). This pin has multiple selectable outputs;
see Table 49, Register 0x01B.
3
O
3.3 V CMOS
LD
Lock Detect (Output). This pin has multiple selectable outputs; see Table 49,
Register 0x01A.
4
I
Power
VCP
Power Supply for Charge Pump (CP); VS ≤ VCP ≤ 5.25 V.
5
O
Loop filter
CP
Charge Pump (Output). This pin connects to an external loop filter. This pin can
be left unconnected if the PLL is not used.
6
O
3.3 V CMOS
STATUS
Status (Output). This pin has multiple selectable outputs; see Table 49,
Register 0x017.
7
I
3.3 V CMOS
REF_SEL
Reference Select. Selects REF1 (low) or REF2 (high). This pin has an internal 30 kΩ
pull-down resistor.
8
I
3.3 V CMOS
SYNC
Manual Synchronizations and Manual Holdover. This pin initiates a manual
synchronization and is also used for manual holdover. Active low. This pin has
an internal 30 kΩ pull-up resistor.
9, 10, 15, 18,
19, 20
N/A
NC
No Connection. These pins can be left floating.
Along with CLK, this is the differential input for the clock distribution section.
13
I
Differential
clock input
CLK
14
I
Differential
clock input
CLK
Along with CLK, this is the differential input for the clock distribution section.
If a single-ended input is connected to the CLK pin, connect a 0.1 μF bypass
capacitor from CLK to ground.
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PDF描述 |
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| AD9517-0ABCPZ-RL7 | 功能描述:IC CLOCK GEN 2.8GHZ VCO 48LFCSP RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 标准包装:2,000 系列:- 类型:PLL 时钟发生器 PLL:带旁路 输入:LVCMOS，LVPECL 输出:LVCMOS 电路数:1 比率 - 输入:输出:2:11 差分 - 输入:输出:是/无 频率 - 最大:240MHz 除法器/乘法器:是/无 电源电压:3.135 V ~ 3.465 V 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:32-LQFP 供应商设备封装:32-TQFP（7x7） 包装:带卷 (TR) |
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