参数资料
型号: AD9520-0/PCBZ
厂商: Analog Devices Inc
文件页数: 18/80页
文件大小: 0K
描述: BOARD EVAL AD9520-0
设计资源: Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121)
Phase Coherent FSK Modulator (CN0186)
AD9520 Eval Brd Schematic
AD9520 BOM
标准包装: 1
主要目的: 计时,时钟发生器
已用 IC / 零件: AD9520-0
已供物品:
Data Sheet
AD9520-0
Rev. A | Page 25 of 80
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1M
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PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
07213-
033
NOTES
1. THE LOOP FILTER USED TO GENERATE THIS PLOT IS SHOWN IN FIGURE 41.
Figure 30. Phase Noise (Absolute) Clock Generation; Internal VCO at
2.703 GHz; PFD = 15.36 MHz; LBW = 63 kHz; LVPECL Output = 122.88 MHz
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PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
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07213-
135
Figure 31. Phase Noise (Absolute), External VCXO (Toyocom TCO-2112)
at 245.76 MHz; PFD = 15.36 MHz; LBW = 250 Hz; LVPECL Output = 245.76 MHz
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PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
INTEGRATED RMS JITTER (12kHz TO 20MHz): 652 fs
07213-
034
NOTES
1. THE LOOP FILTER USED TO GENERATE THIS PLOT IS SHOWN IN FIGURE 42.
Figure 32. Phase Noise (Absolute) Clock Cleanup; Internal VCO at 2.799 GHz;
PFD = 120 kHz; LBW = 2.1 kHz; LVPECL Output = 155.52 MHz
1000
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10
1
0.1
0.01
0.1
1
10
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1000
JITTER FREQUENCY (kHz)
OC-48 OBJECTIVE MASK
AD9520
fOBJ
07213-
134
NOTE: 375UI MAX AT 10Hz OFFSET IS THE
MAXIMUM JITTER THAT CAN BE
GENERATED BY THE TEST EQUIPMENT.
FAILURE POINT IS GREATER THAN 375UI.
IN
P
U
T
J
ITTE
R
A
M
P
LITU
D
E
(
U
Ip-
p)
Figure 33. Telcordia GR-253 Jitter Tolerance Plot
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PDF描述
SRR4018-270Y INDUCTOR POWER 27UH 0.77A 4018
MLF2012E8R2K INDUCTOR MULTILAYER 8.2UH 0805
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AD9515/PCBZ BOARD EVAL CLOCK 2CH AD9515
ECC30DCAN CONN EDGECARD 60POS R/A .100 SLD
相关代理商/技术参数
参数描述
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AD9520-2 制造商:AD 制造商全称:Analog Devices 功能描述:12 LVPECL/24 CMOS Output Clock Generator with Integrated 2.2 GHz VCO