参数资料
| 型号： | AD9522-5BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 11/76页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN 2.4GHZ 64LFCSP |
| 标准包装： | 1 |
| 类型： | 时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:12，2:24 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.4GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
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AD9522-5
Rev. 0 | Page 19 of 76
TYPICAL PERFORMANCE CHARACTERISTICS
275
250
225
200
175
150
125
100
75
0
200
400
600
800
1000
CUR
RE
NT
(
m
A)
FREQUENCY (MHz)
3 CHANNELS—6 LVDS
3 CHANNELS—3 LVDS
2 CHANNELS—2 LVDS
1 CHANNEL—1 LVDS
07
24
0-
1
08
Figure 6. Total Current vs. Frequency, CLK-to-Output (PLL Off), Channel and
VCO Divider Bypassed, LVDS Outputs Terminated 100 Ω Across Differential Pair
240
220
200
180
160
140
120
100
80
0
50
100
150
200
250
CUR
RE
NT
(
m
A)
FREQUENCY (MHz)
2 CHANNELS—8 CMOS
2 CHANNELS—2 CMOS
1 CHANNEL—2 CMOS
1 CHANNEL—1 CMOS
07
24
0-
1
09
Figure 7. Total Current vs. Frequency, CLK-to-Output (PLL Off), Channel and
VCO Divider Bypassed, CMOS Outputs with 10 pF Load
5
4
3
2
1
0
03
3.0
2.5
2.0
1.5
1.0
0.5
CURRE
NT
F
RO
M
CP
P
IN
(
m
A)
VOLTAGE ON CP PIN (V)
.5
PUMP UP
PUMP DOWN
07
24
0-
1
11
Figure 8. Charge Pump Characteristics @ VCP = 3.3 V
5
4
3
2
1
0
05
4.0
3.0
4.5
3.5
2.5
2.0
1.5
1.0
0.5
CURRE
NT
F
RO
M
CP
P
IN
(
m
A)
VOLTAGE ON CP PIN (V)
.0
PUMP DOWN
PUMP UP
07
24
0-
1
12
Figure 9. Charge Pump Characteristics @ VCP = 5.0 V
–140
–145
–150
–155
–160
–165
–170
0.1
1
100
10
P
F
D
P
HAS
E
NO
IS
E
RE
F
E
RR
E
D
T
O
P
F
D
I
NP
UT
(dB
c/
H
z)
PFD FREQUENCY (MHz)
07
24
0-
0
13
Figure 10. PFD Phase Noise Referred to PFD Input vs. PFD Frequency
–208
–210
–212
–214
–216
–218
–220
–222
–224
0
0.4
0.8
1.2
0.2
0.6
1.0
1.4
P
L
F
IG
URE
O
F
M
E
RI
T
(
d
Bc/
H
z)
INPUT SLEW RATE (V/ns)
DIFFERENTIAL INPUT
SINGLE-ENDED INPUT
07
24
0-
1
14
Figure 11. PLL Figure of Merit (FOM) vs. Slew Rate at REFIN/REFIN
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PDF描述 |
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