参数资料
| 型号： | AD9550BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 14/20页 |
| 文件大小： | 0K |
| 描述： | IC INTEGER-N TRANSLATOR 32-LFCSP |
| 标准包装： | 1 |
| 类型： | 时钟/频率转换器 |
| PLL： | 是 |
| 主要目的： | 以太网，GPON，SONET/SHD，T1/E1 |
| 输入： | CMOS |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 810MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-WFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 32-LFCSP-WQ |
| 包装： | 托盘 |
AD9550
Rev. 0 | Page 3 of 20
SPECIFICATIONS
Minimum (min) and maximum (max) values apply for the full range of supply voltage and operating temperature variations. Typical (typ)
values apply for VDD = 3.3 V; TA = 25°C, unless otherwise noted.
Table 1.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
SUPPLY VOLTAGE
3.135
3.30
3.465
V
Pin 18, Pin 21, and Pin 28
POWER CONSUMPTION
Tested with both output channels active at maximum
output frequency; LVPECL and LVDS outputs use a 100 Ω
termination between both pins of the output driver
Total Current
162
185
mA
VDD Current By Pin
Pin 18
93
106
mA
Pin 21
LVDS Configured Output
35
41
mA
LVPECL Configured Output
36
42
mA
CMOS Configured Output
29
34
mA
Pin 28
LVDS Configured Output
35
41
mA
LVPECL Configured Output
36
42
mA
CMOS Configured Output
29
34
mA
LOGIC INPUT PINS
Input Characteristics1
Logic 1 Voltage, V
IH
1.02
V
For the CMOS inputs, a static Logic 1 results from either
a pull-up resistor or no connection
Logic 0 Voltage, V
IL
0.64
V
Logic 1 Current, I
IH
3
A
Logic 0 Current, I
IL
17
A
LOGIC OUTPUT PINS
Output Characteristics
Tested at 1 mA load current
Output Voltage High, V
OH
2.7
V
Output Voltage Low, V
OL
0.19
V
RESET Pin
Input Characteristics2
Input Voltage High, V
IH
1.96
V
Input Voltage Low, V
IL
0.85
V
Input Current High, I
INH
0.3
12.5
A
Input Current Low, I
INL
31
43
A
Minimum Pulse Width Low
150
s
Tested with an active source driving the RESET pin
REFERENCE CLOCK INPUT CHARACTERISTICS
CMOS Single-Ended Input
Input Frequency Range
0.008
200
MHz
Input High Voltage
1.62
V
Input Low Voltage
0.52
V
Input Threshold Voltage
1.0
V
When ac coupling to the input receiver, the user must
dc bias the input to 1 V
Input High Current
0.04
A
Input Low Current
0.03
A
Input Capacitance
3
pF
Duty Cycle
Pulse width high and pulse width low establish the
bounds for duty cycle
Pulse Width Low
2
ns
Pulse Width High
2
ns
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PDF描述 |
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参数描述 |
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| AD9551BCPZ-REEL7 | 功能描述:IC CLOCK GEN TRANSLATOR 40LFCSP RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 标准包装:2,000 系列:- 类型:PLL 时钟发生器 PLL:带旁路 输入:LVCMOS，LVPECL 输出:LVCMOS 电路数:1 比率 - 输入:输出:2:11 差分 - 输入:输出:是/无 频率 - 最大:240MHz 除法器/乘法器:是/无 电源电压:3.135 V ~ 3.465 V 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:32-LQFP 供应商设备封装:32-TQFP（7x7） 包装:带卷 (TR) |
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