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参数资料
| 型号： | AD9571ACPZLVD-R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 2/20页 |
| 文件大小： | 0K |
| 描述： | IC PLL CLOCK GEN 25MHZ 40LFCSP |
| 标准包装： | 750 |
| 类型： | 时钟发生器，扇出配送，多路复用器 |
| PLL： | 是 |
| 输入： | 晶体 |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:10 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 156.25MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 2.97 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-WFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 40-LFCSP-WQ（6x6） |
| 包装： | 带卷 (TR) |
AD9571
Rev. 0 | Page 10 of 20
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
NOTES
1. * = SHORT TO PIN 36.
2. ** = SHORT TO PIN 14.
3. NOTE THAT THE EXPOSED PADDLE ON THIS PACKAGE IS AN ELECTRICAL
CONNECTION AS WELL AS A THERMAL ENHANCEMENT. FOR THE DEVICE TO
FUNCTION PROPERLY, THE PADDLE MUST BE ATTACHED TO GROUND (GND).
PIN 1
INDICATOR
1
GND
2
VS
3
25M
4
25M
5
VS
6
XO
7
XO
8
REFCLK
9
REFSEL
10
GND
23 33M
24 VS
25 VS
26 VS
27 FREQSEL
28 VS
29 25M
30 25M
22 100M/125M
21 100M/125M
11
VS
12
**
13
**
15
VS
17
156M
16
VS
18
156M
19
100M
/125M
20
100M
/125M
14
B
YPA
SS2
33
VS
34
G
ND
35
VS
36
B
YPA
SS1
37
FOR
C
E
_
LOW
38
*
39
VS
40
VS
32
25M
31
25M
TOP VIEW
(Not to Scale)
AD9571
LVPECL/
LVDS
07499-
006
Figure 6. Pin Configuration
Table 13. Pin Function Descriptions1
Pin No.
Mnemonic
Description
2
VS
Power Supply Connection for the 25M CMOS Buffer.
3, 4, 29, 30, 31, 32
25M
CMOS 25 MHz Output.
5
VS
Power Supply Connection for the Crystal Oscillator.
6, 7
XO
External 25 MHz Crystal.
8
REFCLK
25 MHz Reference Clock Input. Tie low when not in use.
9
REFSEL
Logic Input. Used to select the reference source.
11
VS
Power Supply Connection for the GbE PLL.
1, 10, 34
GND
Ground Pins. The external paddle must be attached to GND.
14, 36
BYPASS2, BYPASS1
These pins are for bypassing each LDO to ground with a 220 nF capacitor.
15
VS
Power Supply Connection for the GbE VCO.
16
VS
Power Supply Connection for the 156M LVDS Output Buffer and Output Dividers.
17
156M
LVPECL/LVDS Output at 156.25 MHz.
18
156M
Complementary LVPECL/LVDS Output at 156.25 MHz.
19, 21
100M/125M
LVPECL/LVDS Output at 100 MHz or 125 MHz. Selected by FREQSEL pin strapping.
20, 22
100M/
Complementary LVPECL/LVDS Output at 100 MHz or 125 MHz.
125M
23
33M
CMOS 33.33 MHz Output.
24
VS
Power Supply Connection for the 33M CMOS Output Buffer and Output Dividers.
25
VS
Power Supply Connection for the 100M/125M LVDS Output Buffer and Output Dividers.
26
VS
Power Supply Connection for the GbE PLL Feedback Divider.
27
FREQSEL
Logic Input. Used to configure output drivers.
28
VS
Power Supply Connection for the FC PLL Feedback Divider.
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PDF描述 |
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参数描述 |
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