参数资料
型号: AD9705BCPZ
厂商: Analog Devices Inc
文件页数: 26/44页
文件大小: 0K
描述: IC DAC TX 10BIT 175MSPS 32-LFCSP
产品培训模块: Data Converter Fundamentals
DAC Architectures
标准包装: 1
系列: TxDAC®
设置时间: 11ns
位数: 10
数据接口: 串行
转换器数目: 1
电压电源: 模拟和数字
功率耗散(最大): 50mW
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 32-VFQFN 裸露焊盘,CSP
供应商设备封装: 32-LFCSP-VQ(5x5)
包装: 托盘
输出数目和类型: 2 电流,单极
采样率(每秒): 175M
产品目录页面: 785 (CN2011-ZH PDF)
配用: AD9705-EBZ-ND - BOARD EVAL FOR AD9705
AD9704/AD9705/AD9706/AD9707
Data Sheet
Rev. B | Page 32 of 44
R/W N1N0A4 A3 A2 A1 A0 D7N D6N D5N
D00
D10
D20
D30
INSTRUCTION CYCLE
DATA TRANSFER CYCLE
CSB
SCLK
SDIO
05
92
6-
-091
Figure 72. Serial Register Interface Timing, MSB First Write
R/W N1 N0A4A3
A2 A1 A0
D7
D6N D5N
D00
D10
D20
D30
INSTRUCTION CYCLE
DATA TRANSFER CYCLE
CSB
SCLK
SDIO
SDO
0
592
6-
090
Figure 73. Serial Register Interface Timing, MSB First Read
A0 A1 A2 A3 A4 N0 N1 R/W D00 D10 D20
D7N
D6N
D5N
D4N
INSTRUCTION CYCLE
DATA TRANSFER CYCLE
CSB
SCLK
SDIO
05
92
6-
08
9
Figure 74. Serial Register Interface Timing, LSB First Write
INSTRUCTION CYCLE
DATA TRANSFER CYCLE
CSB
SCLK
SDIO
SDO
A0 A1 A2 A3 A4 N0 N1 R/W
D10 D20
D7N
D6N
D5N
D4N
0
59
26-
088
D0
Figure 75. Serial Register Interface Timing, LSB First Read
INSTRUCTION BIT 6
INSTRUCTION BIT 7
CSB
SCLK
SDIO
tDS
tDH
tPWH
tPWL
tSCLK
05
92
6
-09
2
Figure 76. Timing Diagram for SPI Register Write
I1
I0
D7
D6
D5
tHLD
tSU
CSB
SCLK
SDIO
059
26-
09
3
Figure 77. Timing Diagram for SPI Register Read
SPI REGISTER MAP
Table 15.
Mnemonic
Addr
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
SPI CTL
0x00
SDIODIR
DATADIR
SWRST
LNGINS
PDN
Sleep
CLKOFF
EXREF
Data
0x02
DATAFMT
DCLKPOL
DESKEW
CLKDIFF
CALCLK
Version
0x0D
VER[3]
VER[2]
VER[1]
VER[0]
CALMEM
0x0E
CALMEM[1]
CALMEM[0]
DIVSEL[2]
DIVSEL[1]
DIVSEL[0]
MEMRDWR
0x0F
CALSTAT
CALEN
SMEMWR
SMEMRD
UNCAL
MEMADDR
0x10
MEMADDR[5]
MEMADDR[4]
MEMADDR[3]
MEMADDR[2]
MEMADDR[1]
MEMADDR[0]
MEMDATA
0x11
MEMDATA[5]
MEMDATA[4]
MEMDATA[3]
MEMDATA[2]
MEMDATA[1]
MEMDATA[0]
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