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参数资料
型号： AD9911/PCBZ
厂商： Analog Devices Inc
文件页数： 29/44页
文件大小： 0K
描述： BOARD EVAL FOR AD9911
产品培训模块： Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action
Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter
Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction
Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter
Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator
设计资源： AD9911 Eval Brd Schematics
AD9911 Eval Brd BOM
AD9911 Eval Brd Gerber Files
标准包装： 1
系列： AgileRF™
主要目的： 计时，直接数字合成（DDS）
已用 IC / 零件： AD9911
已供物品： 板
相关产品： AD9911BCPZ-REEL7-ND - IC DDS 500MSPS DAC 10BIT 56LFCSP
AD9911BCPZ-ND - IC DDS 500MSPS DAC 10BIT 56LFCSP
AD9911
Rev. 0 | Page 35 of 44
REGISTER MAPS
CONTROL REGISTER MAP
Table 24.
Register
Name
(Address)
Bit
Range
Bit 7 (MSB)
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0 (LSB)
Default
Value
Channel
Select
Register
(CSR)
(0x00)
<7:0>
Auxiliary
Channel 3
(W/R enable1)
Auxiliary
Channel 2
(W/R enable1)
Primary Channel 1
(W/R enable1)
Auxiliary
Channel 0
(W/R enable1)
Must
be 0
I/0 mode select <2:1>
LSB first
0xF0
Function
Register 1
(FR1)
(0x01)
<7:0>
Reference clock
input power
down
External power
down mode
Sync clock
disable
DAC reference
power down
Open
Test-
tone
enable
Manual
hardware
synchronization
Manual software
synchronization
0x00
<15:8>
Open
Profile pin configuration <14:12>
Ramp up/ramp
down <11:10>
Modulation Level <9:8>
0x00
<23:16>
VCO gain control
PLL divider ratio <22:18>
Charge pump control <17:16>
0x00
Function
Register 2
(FR2)
(0x02)
<7:0>
Multidevice
synchronization
slave enable
Multidevice
synchronization
master enable
Multidevice
synchronization
status
Multidevice
synchronization
mask
Open <3:2>
System clock offset <1:0>
0x00
<15:8>
All channels auto
clear sweep
accumulator
All channels
clear sweep
accumulator
All channels auto
clear phase
accumulator
All channels
clear phase
accumulator
Open <11:10>
Open <9:8>
0x00
1 Channel enable bits do not require an I/O update to be activated. These bits are active immediately after the byte containing the bits is written. All other bits need an
I/O update to become active. The channel enable bits determine if the channel registers and/or profile registers are written to or not.
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PDF描述
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参数描述
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