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参数资料
| 型号： | ADE7758ARWZRL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 67/72页 |
| 文件大小： | 0K |
| 描述： | IC ENERGY METERING 3PHASE 24SOIC |
| 标准包装： | 1,000 |
| 输入阻抗： | 380 千欧 |
| 测量误差： | 0.1% |
| 电压 - 高输入/输出： | 2.4V |
| 电压 - 低输入/输出： | 0.8V |
| 电流 - 电源： | 8mA |
| 电源电压： | 4.75 V ~ 5.25 V |
| 测量仪表类型： | 3 相 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 24-SOIC W |
| 包装： | 带卷 (TR) |
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Data Sheet
ADE7758
LINE CYCLE ACCUMULATION MODE REGISTER (0x17)
The functionalities involved the line-cycle accumulation mode in the ADE7758 are defined by writing to the LCYCMODE register.
Table 22 summarizes the functionality of each bit in the LCYCMODE register.
Table 22. LCYCMODE Register
Bit
Bit
Default
Location
0
Mnemonic
LWATT
Value
0
Description
Setting this bit places the watt-hour accumulation registers (AWATTHR, BWATTHR, and CWATTHR
registers) into line-cycle accumulation mode.
1
LVAR
0
Setting this bit places the VAR-hour accumulation registers (AVARHR, BVARHR, and CVARHR registers)
into line-cycle accumulation mode.
2
LVA
0
Setting this bit places the VA-hour accumulation registers (AVAHR, BVAHR, and CVAHR registers) into
line-cycle accumulation mode.
3 to 5
ZXSEL
7
These bits select the phases used for counting the number of zero crossings in the line-cycle
accumulation mode. Bit 3, Bit 4, and Bit 5 select Phase A, Phase B, and Phase C, respectively. More than
one phase can be selected for the zero-crossing detection, and the accumulation time is shortened
accordingly.
6
RSTREAD
1
Setting this bit enables the read-with-reset for all the WATTHR, VARHR, and VAHR registers for all three
phases, that is, a read to those registers resets the registers to 0 after the content of the registers have
been read. This bit should be set to Logic 0 when the LWATT, LVAR, or LVA bits are set to Logic 1.
7
FREQSEL
0
Setting this bit causes the FREQ (0x10) register to display the period, instead of the frequency of the
line input.
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相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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