参数资料
| 型号： | ADF4212LBRUZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 27/28页 |
| 文件大小： | 0K |
| 描述： | IC PLL FREQ SYNTHESIZER 20TSSOP |
| 标准包装： | 75 |
| 类型： | 时钟/频率合成器（RF/IF） |
| PLL： | 是 |
| 输入： | CMOS，TTL |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 3:1 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.4GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 2.7 V ~ 3.3 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
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ADF4212L
Data Sheet
Rev. E | Page 8 of 28
Pin No.
Mnemonic
TSSOP
LFCSP
Description
VDD2
20
18
Power Supply for the IF, Digital, and Interface Section. Decoupling capacitors to the ground plane
should be placed as close as possible to this pin. VDD2 should have a value of between 2.6 V and 3.3 V.
VDD2 must have the same potential as VDD1.
VDD1
1
19
Power Supply for the RF Section. Decoupling capacitors to the ground plane should be placed as close
as possible to this pin. VDD1 should have a value of between 2.6 V and 3.3 V. VDD1 must have the same
potential as VDD2.
VP1
2
20
Power Supply for the RF Charge Pump. This should be greater than or equal to VDD1. In systems where
VDD1 is 3 V, it can be set to 5.5 V and used to drive a VCO with a tuning range up to 5.5 V.
EP
Exposed
Pad
It is recommended that the exposed pad be thermally connected to a copper plane for enhanced
thermal performance. The pad should be grounded as well.
相关PDF资料 |
PDF描述 |
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参数描述 |
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