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参数资料
| 型号： | ADG526ATQ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 14/20页 |
| 文件大小： | 0K |
| 描述： | IC MULTIPLEXER 16X1 28CDIP |
| 产品培训模块： | Switch Fundamentals |
| 标准包装： | 12 |
| 功能： | 多路复用器 |
| 电路： | 1 x 16:1 |
| 导通状态电阻： | 700 欧姆 |
| 电压电源： | 单/双电源 |
| 电压 - 电源，单路/双路(±)： | 10.8 V ~ 16.5 V，±10.8 V ~ 16.5 V |
| 电流 - 电源： | 600µA |
| 工作温度： | -55°C ~ 125°C |
| 安装类型： | 通孔 |
| 封装/外壳： | 28-CDIP（0.600"，15.24mm） |
| 供应商设备封装： | 28-CDIP |
| 包装： | 管件 |
ADG526A/ADG527A
Rev. C | Page 3 of 20
SPECIFICATIONS
DUAL SUPPLY
VDD = 10.8 V to 16.5 V, VSS = 10.8 V to 16.5 V, unless otherwise noted.
Table 1.
Parameter
ADG526A/ADG527A
ADG526A
Unit
Comments
K Version
B Version
T Version
25°C
40°C to +85°C
25°C
40°C to +85°C
25°C
55°C to +125°C
ANALOG SWITCH
Analog Signal Range
VSS
V min
VDD
V max
RON
280
Ω typ
10 V ≤ VS ≤ +10 V, IDS = 1 mA;
see Figure 15
450
600
450
600
450
600
Ω max
300
400
300
400
Ω max
VDD = +15 V (±10%),
VSS = 15 V (±10%)
300
400
Ω max
VDD = +15 V (±5%),
VSS = 15 V (±5%)
RON Drift
0.6
%/°C typ
10 V ≤ VS ≤ +10 V, IDS = 1 mA
RON Match
5
% typ
10 V ≤ VS ≤ +10 V, IDS = 1 mA
IS (Off), Off Input Leakage
0.02
nA typ
V1 = ±10 V, V2 = 10 V;
see Figure 16
1
50
1
50
1
50
nA max
ID (Off), Off Output
Leakage
0.04
nA typ
V1 = ±10 V, V2 = 10 V;
ADG526A
1
200
1
200
1
200
nA max
ADG527A
1
100
1
100
nA max
ID (On), On Channel
Leakage
0.04
nA typ
V1 = ±10 V, V2 = 10 V;
see Figure 18
ADG526A
1
200
1
200
1
200
nA max
ADG527A
1
100
1
100
nA max
IDIFF, Differential Off
Output Leakage
25
nA max
V1 = ±10 V, V2 = 10 V;
see Figure 19
(ADG527A Only)
DIGITAL CONTROL
VINH, Input High Voltage
2.4
V min
VINL, Input Low Voltage
0.8
V max
IINL or IINH
1
μA max
VIN = 0 to VDD
CIN, Digital Input
Capacitance
8
pF max
DYNAMIC
CHARACTERISTICS1
tTRANSITION
200
ns typ
V1 = ±10 V, V2 = 10 V;
see Figure 20
300
400
300
400
300
400
ns max
tOPEN
50
ns typ
See Figure 21
25
10
25
10
25
10
ns min
tON (EN, WR)
200
ns typ
300
400
300
400
300
400
ns max
tOFF (EN, RS)
200
ns typ
300
400
300
400
300
400
ns max
tW , Write Pulse Width
100
120
100
120
100
130
ns min
See Figure 13
tS, Address Enable Setup
Time
100
ns min
See Figure 13
tH, Address Enable Hold
Time
10
ns min
See Figure 13
tRS, Reset Pulse Width
100
ns min
See Figure 14
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PDF描述 |
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参数描述 |
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