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参数资料
| 型号： | ADG633YRU-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 14/16页 |
| 文件大小： | 0K |
| 描述： | IC SWITCH TRIPLE SPDT 16TSSOP |
| 产品培训模块： | Switch Fundamentals |
| 标准包装： | 1,000 |
| 功能： | 开关 |
| 电路： | 3 x SPDT - NC/NO |
| 导通状态电阻： | 150 欧姆 |
| 电压电源： | 单/双电源 |
| 电压 - 电源，单路/双路(±)： | 2 V ~ 12 V，±2 V ~ 6 V |
| 电流 - 电源： | 10nA |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 带卷 (TR) |
ADG633
Rev. A | Page 7 of
16
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
1
2
3
4
5
6
7
8
S2A
S3B
D3
VSS
EN
S3A
S2B
GND
16
15
14
13
12
11
10
9
D2
D1
S1B
A1
A2
A0
S1A
VDD
ADG633
TOP VIEW
(Not to Scale)
03
27
5-
00
2
Figure 2. TSSOP Pin Configuration
NOTES
1. THE EXPOSED PADDLE CAN BE LEFT FLOATING
OR BE TIED TO VDD, VSS, OR GND.
PIN 1
INDICATOR
1
S3B
2
D3
3
S3A
4
EN
11 S1B
12 D1
10 S1A
9A0
5
V
S
6
G
N
D
7
A
2
8
A
1
5
S
2
B
1
6
S
2
A
1
4
V
D
1
3
D
2
ADG633
TOP VIEW
(Not to Scale)
03
27
5-
00
3
Figure 3. LFCSP Pin Configuration
Table 5. Pin Function Descriptions
Pin No.
Mnemonic
Description
TSSOP
LFCSP
1
15
S2B
Source Terminal of Multiplexer 2. Can be an input or output.
2
16
S2A
Source Terminal of Multiplexer 2. Can be an input or output.
3
1
S3B
Source Terminal of Multiplexer 3. Can be an input or output.
4
2
D3
Drain Terminal of Multiplexer 3. Can be an input or output.
5
3
S3A
Source Terminal of Multiplexer 3. Can be an input or output.
6
4
EN
Digital Control Input. Disables all multiplexers when set high.
7
5
VSS
Most Negative Power Supply Terminal. Tie this pin to GND when using the device with single-supply
voltages.
8
6
GND
Ground (0 V) Reference.
9
7
A2
Digital Control Input.
10
8
A1
Digital Control Input.
11
9
A0
Digital Control Input.
12
10
S1A
Source Terminal of Multiplexer 1. Can be an input or output.
13
11
S1B
Source Terminal of Multiplexer 1. Can be an input or output.
14
12
D1
Drain Terminal of Multiplexer 1. Can be an input or output.
15
13
D2
Drain Terminal of Multiplexer 2. Can be an input or output.
16
14
VDD
Most Positive Power Supply Terminal.
N/A
EP
Exposed Paddle. The exposed paddle can be left floating or be tied to VDD, VSS, or GND.
Table 6. ADG633 Truth Table
Switch Condition
A2
A1
A0
EN
Switch S1A-D1
Switch S1B-D1
Switch S2A-D2
Switch S2B-D2
Switch S2A-D3
Switch S3B-D3
X1
1
Off
0
On
Off
On
Off
On
Off
0
1
0
Off
On
Off
On
Off
0
1
0
On
Off
On
Off
0
1
0
Off
On
Off
On
Off
1
0
On
Off
On
Off
On
1
0
1
0
Off
On
Off
On
1
0
On
Off
On
Off
On
1
0
Off
On
Off
On
Off
On
1 X = the logic state does not matter; it can be either 0 or 1.
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