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参数资料
| 型号： | ADP322ACPZ-145-R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 4/24页 |
| 文件大小： | 0K |
| 描述： | IC REG LDO 3.3/2.5/1.2V 16LFCSP |
| 标准包装： | 1 |
| 稳压器拓扑结构： | 正，固定式 |
| 输出电压： | 3.3V，2.5V，1.2V |
| 输入电压： | 1.8 V ~ 5.5 V |
| 电压 - 压降（标准）： | 0.11V @ 200mA，0.11V @ 200mA，- |
| 稳压器数量： | 3 |
| 电流 - 输出： | 200mA（最小值） |
| 电流 - 限制（最小）： | 250mA |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-WFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 16-LFCSP-WQ（3x3） |
| 包装： | 标准包装 |
| 其它名称： | ADP322ACPZ-145-R7DKR |
ADP322/ADP323
Data Sheet
Parameter
Symbol
Conditions
Min
Typ
Max
Unit
EN INPUT
EN Input Logic High
EN Input Logic Low
EN Input Leakage Current
V IH
V IL
V I-LEAKAGE
2.5 V ≤ V BIAS ≤ 5.5 V
2.5 V ≤ V BIAS ≤ 5.5 V
EN1 = EN2 = EN3 = V IN or GND
EN1 = EN2 = EN3 = V IN or GND,
1.2
0.1
0.4
1
V
V
μA
μA
T J = ?40°C to +125°C
UNDERVOLTAGE LOCKOUT
UVLO
Input Bias Voltage (VBIAS)
UVLO RISE
2.45
V
Rising
Input Bias Voltage (VBIAS)
UVLO FALL
2.0
V
Falling
Hysteresis
UVLO HYS
180
mV
OUTPUT NOISE
POWER SUPPLY REJECTION RATIO
OUT NOISE
PSRR
10 Hz to 100 kHz, V IN = 5 V, V OUT = 3.3 V
10 Hz to 100 kHz, V IN = 5 V, V OUT = 2.8 V
10 Hz to 100 kHz, V IN = 3.6 V, V OUT = 2.5 V
10 Hz to 100 kHz, V IN = 3.6 V, V OUT = 1.2 V
V IN = 1.8 V, V OUT = 0.8 V, I OUT = 100 mA
100 Hz
1 kHz
10 kHz
100 kHz
1 MHz
63
55
50
29
70
70
70
60
40
μV rms
μV rms
μV rms
μV rms
dB
dB
dB
dB
dB
V IN = 3.8 V, V OUT = 2.8 V, I OUT = 100 mA
100 Hz
1 kHz
10 kHz
100 kHz
1 MHz
68
62
68
60
40
dB
dB
dB
dB
dB
1
2
3
4
5
Accuracy when VOUTx is connected directly to FBx. When the VOUTx voltage is set by external feedback resistors, the absolute accuracy in adjust mode depends on
the tolerances of the resistors used.
Based on an end-point calculation using 1 mA and 200 mA loads.
The dropout voltage specification applies only to output voltages greater than 1.8 V. Dropout voltage is defined as the input-to-output voltage differential when the
input voltage is set to the nominal output voltage.
Start-up time is defined as the time between the rising edge of ENx to VOUTx being at 90% of its nominal value.
Current-limit threshold is defined as the current at which the output voltage drops to 90% of the specified typical value. For example, the current limit for a 3.0 V
output voltage is defined as the current that causes the output voltage to drop to 90% of 3.0 V, that is, 2.7 V.
INPUT AND OUTPUT CAPACITOR, RECOMMENDED SPECIFICATIONS
Table 2.
Parameter
MINIMUM INPUT AND OUTPUT CAPACITANCE 1
CAPACITOR ESR
Symbol
C MIN
R ESR
Conditions
T A = ?40°C to +125°C
T A = ?40°C to +125°C
Min
0.70
0.001
Typ
Max
1
Unit
μF
Ω
1
The minimum input and output capacitance should be greater than 0.70 μF over the full range of operating conditions. The full range of operating conditions in the
application must be considered during device selection to ensure that the minimum capacitance specification is met. X7R and X5R type capacitors are recommended;
Y5V and Z5U capacitors are not recommended for use with LDOs.
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