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参数资料
| 型号： | ADSP-21060LKS-160 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 44/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 32BIT 240MQFP |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | 主机接口，连接端口，串行端口 |
| 时钟速率： | 40MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 512kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 3.30V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 240-BFQFP 裸露焊盘 |
| 供应商设备封装： | 240-MQFP-EP（32x32） |
| 包装： | 托盘 |
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ADSP-21060/ADSP-21060L/ADSP-21062/ADSP-21062L/ADSP-21060C/ADSP-21060LC
Rev. F
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March 2008
Output Characteristics (3.3 V)
Figure 35. ADSP-21062 Typical Output Drive Currents (VDD = 3.3 V)
Figure 36. Typical Output Delay or Hold vs. Load Capacitance (at Maximum
Case Temperature) (VDD = 3.3 V)
SOURCE VOLTAGE - V
120
-
20
-
80
03.5
S
O
U
R
C
E
C
U
R
E
N
T
-
m
A
0.5
1.0
1.5
2.0
2.5
3.0
100
0
-
40
-
60
20
80
40
-
100
-
120
3.0V, +85°C
3.3V, +25°C
3.6V, -40°C
3.3V, +25°C
3.0V, +85°C
VOH
VOL
LOAD CAPACITANCE - pF
O
U
T
P
U
T
D
E
L
A
Y
O
R
H
O
L
D
-
n
s
5
-
1
25
200
50
75
100
125
150
175
4
3
2
1
NOMINAL
Y= 0.0329x
- 1.65
Figure 37. Typical Output Rise Time (10% to 90% VDD) vs. Load Capacitance
(VDD = 3.3 V)
Figure 38. Typical Output Rise Time (0.8 V to 2.0 V) vs. Load Capacitance
(VDD = 3.3 V)
LOAD CAPACITANCE - pF
0
2
0
20
40
60
80
100
120
Y = 0.0796x + 1.17
Y = 0.0467x + 0.55
RISE TIME
FALL TIME
140
160
180
200
4
6
8
10
12
14
16
18
R
IS
E
A
N
D
F
A
L
T
IM
E
S
-
n
s
(1
0
%
to
9
0
%
)
LOAD CAPACITANCE - pF
0
20
40
60
80
100
120
Y = 0.0391x + 0.36
Y = 0.0305x + 0.24
RISE TIME
FALL TIME
140
160
180
200
R
IS
E
A
N
D
F
A
L
T
IM
E
S
-
n
s
(0
.8
V
to
2
.0
V
)
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